参数资料
| 型号： | MC34708VM |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 25/159页 |
| 文件大小： | 0K |
| 描述： | IC POWER MANAGEMENT 206MAPBGA |
| 标准包装： | 160 |
| 应用： | 通用 |
| 电源电压： | 1.8 V ~ 4.5 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 206-LFBGA |
| 供应商设备封装： | 206-MAPBGA（13x13） |
| 包装： | 托盘 |
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Functional Block Description
Table 11. Power Up Defaults
i.MX
Reserved
53
LPM
53
DDR2
53
DDR3
53
LVDDR3
53
LVDDR2
50
MDDR
50 50 50 50 50
LPDDR2 LPDDR2 MDDR LPDDR2 MDDR
VSRTC
VPLL
VREFDDR
VDAC
VGEN1
VGEN2
Reserved
Reserved
Reserved
Reserved
Reserved
Reserved
1.2
1.8
On
2.775
1.2
2.5
1.3
1.8
On
2.775
1.3
2.5
1.3
1.8
On
2.775
1.3
2.5
1.3
1.8
On
2.775
1.3
2.5
1.3
1.8
On
2.775
1.3
2.5
1.2
1.8
On
2.5
1.2
3.1
1.2
1.8
On
2.5
1.2
3.1
1.2
1.8
On
2.5
1.2
3.1
1.2
1.8
On
2.5
1.2
3.1
1.2
1.8
On
2.5
1.2
2.5
1.2
1.8
On
2.5
1.2
2.5
Notes
31. The SWx node are activated in APS mode when enabled by the startup sequencer.
32. VUSB regulator is only enabled if 5.0 V is present on VBUS. By default VUSB will be supplied by VBUS. SWBST = 5.0 V powers up as
does VUSB, regardless of 5.0 V present on UVBUS. By default VUSB is supplied by SWBST.
The power up sequence is shown in Tables 12 and 13 . VCOREDIG, VSRTC, and VCORE, are brought up in the pre-sequencer
startup.
Table 12. Power Up Sequence i.MX53
Tap x 2.0 ms
0
1
2
3
4
5
6
7
8
9
PUMS [4:1] = [0101,0110,0111,1000,1001] (i.MX53)
SW2 (VCC)
VPLL (NVCC_CKIH = 1.8 V)
VGEN2 (VDD_REG= 2.5 V, external PNP
SW3 (VDDA)
SW1A/B (VDDGP)
SW4A/B, VREFDDR (DDR/SYS)
SW5 (I/O), VGEN1
VUSB (33) , VUSB2
VDAC
Notes:
33. The VUSB regulator is only enabled if 5.0 V is present on the VBUS pin. By
default VUSB will be supplied by the VBUS pin.
MC34708
Analog Integrated Circuit Device Data ?
25
Freescale Semiconductor
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