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参数资料
| 型号： | MC68322FT20 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, 20 MHz, RISC PROCESSOR, PQFP160 |
| 封装： | PLASTIC, QFP-160 |
| 文件页数： | 128/283页 |
| 文件大小： | 1602K |
| 代理商： | MC68322FT20 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页当前第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页第197页第198页第199页第200页第201页第202页第203页第204页第205页第206页第207页第208页第209页第210页第211页第212页第213页第214页第215页第216页第217页第218页第219页第220页第221页第222页第223页第224页第225页第226页第227页第228页第229页第230页第231页第232页第233页第234页第235页第236页第237页第238页第239页第240页第241页第242页第243页第244页第245页第246页第247页第248页第249页第250页第251页第252页第253页第254页第255页第256页第257页第258页第259页第260页第261页第262页第263页第264页第265页第266页第267页第268页第269页第270页第271页第272页第273页第274页第275页第276页第277页第278页第279页第280页第281页第282页第283页
Electrical and Thermal Characteristics
14-4
MC68322 USER’S MANUAL
MOTOROLA
14.4.2 MC68322 Bus Timing
The timing diagrams that follow illustrate core reads and writes. Figures 14-3 through 14-5
illustrate combinations of chip-select parameters that produce zero wait-state reads on the
EC000 bus. Figures 14-6 through 14-9 illustrate combinations of chip-select parameters that
produce one wait-state reads on the EC000 bus. Figure 14-11 illustrates the only
combination of chip-select parameters that produce zero wait-state writes on the EC000
bus. Figures 14-12 through 14-14 illustrate combinations of chip-select parameters that
produce one wait-state writes on the EC000 bus. The access times for each timing diagram
are shown in parentheses in CLK2s. The numbers within the parentheses are defined as
follows:
(Setup:Access:Hold:Recover)
The Setup value indicates the number of CLK2s between the assertion of the chip-select
and RD, WRU, or WRL. The Access value indicates the number of CLK2s that the RD,
WRU, or WRL signal will remain asserted. The Hold value indicates the number of CLK2s
between the negation of RD, WRU, or WRL and chip-select. Note that some of the access
times are flagged with an asterisk (*) because the access has a hold time of -1 CLK2s. This
situation occurs whenever the “hold” value in one of the chip-select registers is set to zero.
In this case, the chip-select actually negates one CLK2 before the RD, WRU, or WRL. This
is important because for reads in such cases, the data must be set up to the negation of the
chip-select rather than the negation of the RD signal. The Recover value indicates the
number of CLK2s between the negation and reassertion of the chip-select (chip-select high
time.) These timing diagrams are all shown without extra recovery clocks, so the recovery
time for each of the cycles will be 3 CLK2s.
NUM
CHARACTERISTIC
MIN
MAX
UNIT
8
Address Bus Valid from CLK2, EC000 Cycle
3
30
ns
9
Address Bus Valid from CLK2, DMA Cycle
2
20
ns
10
Data Bus Driven and Valid from CLK2
2
20
ns
11
Data Bus High Impedance from CLK2
2
20
ns
12
Data Bus Setup before CLK2
2—
ns
13
Data Bus Hold after CLK2
5—
ns
14
CS7–CS0 Valid from CLK2, EC000 Cycle
3
30
ns
15
CS7–CS0 Valid from CLK2, DMA Cycle
2
20
ns
16
RD, WRL, WRU Valid from CLK2
2
20
ns
17
WAIT Asynchronous Input Hold after CLK2 *
5
—
ns
18
AS, R/W Valid from CLK2
330
ns
NOTE: WAIT is an asynchronous input and is synchronized internally by the MC68322. It requires no setup or hold time in order to be
recognized for proper operation. However, to guarantee recognition of the input at a certain edge of CLK2, WAITmust satisfy the hold
requirement.
F
re
e
sc
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S
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n
d
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c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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