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参数资料
| 型号： | MC68322FT20 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, 20 MHz, RISC PROCESSOR, PQFP160 |
| 封装： | PLASTIC, QFP-160 |
| 文件页数： | 251/283页 |
| 文件大小： | 1602K |
| 代理商： | MC68322FT20 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页第197页第198页第199页第200页第201页第202页第203页第204页第205页第206页第207页第208页第209页第210页第211页第212页第213页第214页第215页第216页第217页第218页第219页第220页第221页第222页第223页第224页第225页第226页第227页第228页第229页第230页第231页第232页第233页第234页第235页第236页第237页第238页第239页第240页第241页第242页第243页第244页第245页第246页第247页第248页第249页第250页当前第251页第252页第253页第254页第255页第256页第257页第258页第259页第260页第261页第262页第263页第264页第265页第266页第267页第268页第269页第270页第271页第272页第273页第274页第275页第276页第277页第278页第279页第280页第281页第282页第283页
TABLE OF CONTENTS (Continued)
Paragraph
Page
Number
Title
Number
MOTOROLA
MC68322 USER’S MANUAL
ix
Section 7
DRAM Controller
7.1
DRAM Registers and Banks .................................................................7-1
7.1.1
Base Address and Size Fields ...................................................7-1
7.1.2
ROM Mode .................................................................................7-2
7.1.2.1
Functional Description ....................................................7-2
7.1.2.2
Timing Example ..............................................................7-3
7.1.2.3
Address Demultiplexing Circuit .......................................7-4
7.1.2.4
Operational Example ......................................................7-4
7.2
DRAM Control Register ........................................................................7-5
7.3
DRAM Timing Modes ...........................................................................7-5
7.4
DRAM Accesses ..................................................................................7-6
7.4.1
DRAM Refresh Cycles ...............................................................7-6
7.4.2
DRAM Read Cycles ...................................................................7-7
7.4.3
DRAM Write Cycles ....................................................................7-8
7.4.4
DRAM Bus Arbitration ................................................................7-9
7.4.5
DRAM Burst Accesses .............................................................7-10
7.5
Power-Up Sequence ..........................................................................7-10
Section 8
DMA Interface
8.1
DMA Configuration Registers ...............................................................8-2
8.1.1
Transfer Address Fields .............................................................8-2
8.1.2
Transfer Count Fields .................................................................8-3
8.1.3
Flush Request Fields ..................................................................8-3
8.2
GDMA Control Register ........................................................................8-3
8.3
DMA Speed Register ............................................................................8-4
8.4
DMA Interrupt Event Registers .............................................................8-5
8.5
Initiating A DMA Operation ...................................................................8-6
8.6
DMA Transfers .....................................................................................8-6
8.6.1
PDMA Transfers .........................................................................8-7
8.6.2
GDMA MC68322 Bus Read and Write Cycles ...........................8-7
8.6.3
GDMA DRAM Bus Read and Write Cycles ................................8-8
8.7
DMA Transfer Termination ...................................................................8-9
8.7.1
Normal Termination ....................................................................8-9
8.7.2
Bad Address Termination .........................................................8-10
8.7.3
Core-Forced Termination .........................................................8-10
F
re
e
sc
a
le
S
e
m
ic
o
n
d
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c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
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PDF描述 |
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