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参数资料
| 型号： | MC8640DHX1250HE |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 1250 MHz, MICROPROCESSOR, CBGA1023 |
| 封装： | 33 X 33 MM, CERAMIC, FCBGA-1023 |
| 文件页数： | 41/130页 |
| 文件大小： | 1495K |
| 代理商： | MC8640DHX1250HE |
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MPC8640 and MPC8640D Integrated Host Processor Hardware Specifications, Rev. 3
18
Freescale Semiconductor
RESET Initialization
Note that at MPX = 400 MHz, cfg_plat_freq = 0 and at MPX > 400 MHz, cfg_plat_freq = 1. Therefore,
when operating PCI Express in x8 link width, the MPX platform frequency must be 400 MHz with
cfg_plat_freq = 0 or greater than or equal to 527 MHz with cfg_plat_freq = 1.
For proper Serial RapidIO operation, the MPX clock frequency must be greater than:
2 × (0.80) × (Serial RapidIO interface frequency) × (Serial RapidIO link width)
64
4.5
Other Input Clocks
For information on the input clocks of other functional blocks of the platform such as SerDes, and eTSEC,
see the specific section of this document.
5
RESET Initialization
This section describes the AC electrical specifications for the RESET initialization timing requirements of
the MPC8640. Table 11 provides the RESET initialization AC timing specifications.
Table 12 provides the PLL lock times.
Table 11. RESET Initialization Timing Specifications
Parameter
Min
Max
Unit
Notes
Required assertion time of HRESET
100
—
μs—
Minimum assertion time for SRESET_0 & SRESET_1
3
—
SYSCLKs
1
Platform PLL input setup time with stable SYSCLK before HRESET
negation
100
—
μs2
Input setup time for POR configs (other than PLL config) with respect to
negation of HRESET
4
—
SYSCLKs
1
Input hold time for all POR configs (including PLL config) with respect to
negation of HRESET
2
—
SYSCLKs
1
Maximum valid-to-high impedance time for actively driven POR configs
with respect to negation of HRESET
—
5
SYSCLKs
1
Notes:
1. SYSCLK is the primary clock input for the MPC8640.
2 This is related to HRESET assertion time. Stable PLL configuration inputs are required when a stable SYSCLK is applied. See
the
MPC8641D Integrated Host Processor Reference Manual for more details on the power-on reset sequence.
Table 12. PLL Lock Times
Parameter
Min
Max
Unit
Notes
(Platform and E600) PLL lock times
—
100
μs1
Local bus PLL
—
50
μs—
Notes:
1.The PLL lock time for e600 PLLs require an additional 255 MPX_CLK cycles.
相关PDF资料 |
PDF描述 |
|---|---|
| MC8640DHX1067NC | 32-BIT, 1067 MHz, MICROPROCESSOR, CBGA1023 |
| MC8640DTVU1000HE | 32-BIT, 1000 MHz, MICROPROCESSOR, CBGA1023 |
| MC8640DTHX1067NC | 32-BIT, 1067 MHz, MICROPROCESSOR, CBGA1023 |
| MC8640THX1250HC | 32-BIT, 1250 MHz, MICROPROCESSOR, CBGA1023 |
| MC8640DTVU1250HE | 32-BIT, 1250 MHz, MICROPROCESSOR, CBGA1023 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| MC8640DHX1250N | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:Integrated Host Processor Hardware Specifications Addendum for the MC8640xTxxyyyyaC Series |
| MC8640DTHX1000H | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:Integrated Host Processor Hardware Specifications |
| MC8640DTHX1000HC | 功能描述:微处理器 - MPU G8 REV2.1 1.05V -40/105C RoHS:否 制造商:Atmel 处理器系列:SAMA5D31 核心:ARM Cortex A5 数据总线宽度:32 bit 最大时钟频率:536 MHz 程序存储器大小:32 KB 数据 RAM 大小:128 KB 接口类型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作电源电压:1.8 V to 3.3 V 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-324 |
| MC8640DTHX1000HE | 功能描述:微处理器 - MPU G8 REV 3.0 1.05V -40/105C RoHS:否 制造商:Atmel 处理器系列:SAMA5D31 核心:ARM Cortex A5 数据总线宽度:32 bit 最大时钟频率:536 MHz 程序存储器大小:32 KB 数据 RAM 大小:128 KB 接口类型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作电源电压:1.8 V to 3.3 V 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-324 |
| MC8640DTHX1000N | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:Integrated Host Processor Hardware Specifications Addendum for the MC8640xTxxyyyyaC Series |
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