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参数资料
| 型号： | MSC7119VM1200 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 数字信号处理 |
| 英文描述： | 0-BIT, 300 MHz, OTHER DSP, PBGA400 |
| 封装： | LEAD FREE, MAPBGA-400 |
| 文件页数： | 34/60页 |
| 文件大小： | 1138K |
| 代理商： | MSC7119VM1200 |
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MSC7119 Data Sheet, Rev. 8
Pin Assignments
Freescale Semiconductor
4
1
Pin Assignments
This section includes diagrams of the MSC7119 package ball grid array layouts and pinout allocation tables.
1.1
MAP-BGA Ball Layout Diagrams
Top and bottom views of the MAP-BGA package are shown in Figure 2 and Figure 3 with their ball location index numbers.
Figure 2. MSC7119 Molded Array Process-Ball Grid Array (MAP-BGA), Top View
12345
6789
10
11
12
13
14
15
16
17
18
19
20
A
GND
DQM1
DQS2
CK
HD15
HD12
HD10
HD7
HD6
HD4
HD1
HD0
GND
BM3
NC
B
VDDM
NC
CS0
DQM2
DQS3
DQS0
CKE
WE
HD14
HD11
HD8
HD5
HD2
NC
BM2
NC
C
D24
D30
D25
CS1
DQM3
DQM0
DQS1
RAS
CAS
HD13
HD9
HD3
NCNCNC
NCNCNCNCNC
D
VDDM
D28
D27
GND
VDDM
VDDIO
VDDC
NC
E
GND
D26
D31
VDDM
VDDC
VDDM
VDDIO
VDDC
NC
F
VDDM
D15
D29
VDDC
GND
VDDM
GND
VDDIO
VDDC
NC
G
GND
D13
GND
VDDM
GND
VDDIO
VDDC
NC
HD14
D12
D11
VDDM
GND
VDDIO
VDDC
NC
HA2
HA1
JD10
VDDM
D9
VDDM
GND
VDDIO
VDDC
HA3
HACK
HREQ
K
D0
GND
D8
VDDC
VDDM
GND
VDDIO
VDDC
HA0
HDDS
HDS
L
D1
GND
D3
VDDC
VDDM
GND
VDDIO
VDDC
HCS2
HCS1
HRW
MD2
VDDM
D5
VDDM
GND
VDDC
SDA
UTXD
URXD
ND4
D6
VREF
VDDM
GND
VDDIO
VDDC
CLKIN
SCL
VSSPLL
PD7
D17
D16
VDDM
GND
VDDIO
VDDC PORESET TPSEL VDDPLL
R
GND
D19
D18
VDDM
GND
VDDM
GND
VDDM
GND
VDDIO
GND
VDDIO
VDDC
TDO
EE0
TEST0
T
VDDM
D20
D22
VDDM
VDDC
VDDM
VDDC
VDDM
VDDIO
VDDC
MDIO
TMS
HRESET
U
GND
D21
D23
VDDM
VDDC
COL
TCK
TRST
V
VDDM
NC
A13
A11
A10
A5
A2
BA0
NC
EVNT0 EVNT4 T0TCK
T1RFS
T1TD
TX_ER
RXD2
RXD0
TX_EN
CRS
TDI
WGND
VDDM
A12
A8
A7
A6
A3
NC
EVNT1 EVNT2 T0RFS
T0TFS
T1RD
T1TFS
TXD2
RXD3
TXD1
TXCLK RX_ER
MDC
Y
VDDM
GND
A9A1A0
A4
BA1
NMI
EVNT3 T0RCK
T0RD
TOTD
T1RCK T1TCK
TXD3
RXCLK
TXD0
RXD1
GND
RX_DV
Top View
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