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参数资料
| 型号： | MT42L256M32D4MG-25 IT:A |
| 厂商： | Micron Technology Inc |
| 文件页数： | 47/164页 |
| 文件大小： | 0K |
| 描述： | IC LPDDR2 SDRAM 8GBIT 134FBGA |
| 标准包装： | 1,000 |
| 格式 - 存储器： | RAM |
| 存储器类型： | 移动 LPDDR2 SDRAM |
| 存储容量： | 8G（356M x 32） |
| 速度： | 400MHz |
| 接口： | 并联 |
| 电源电压： | 1.14 V ~ 1.3 V |
| 工作温度： | -25°C ~ 85°C |
| 封装/外壳： | 134-TFBGA |
| 供应商设备封装： | 134-FBGA（11.5x11.5） |
| 包装： | 散装 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页当前第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页
2Gb: x16, x32 Mobile LPDDR2 SDRAM S4
Mode Register Definition
Table 15: Burst Sequence by Burst Length (BL), Burst Type (BT), and Wrap Control (WC) (Continued)
Notes 1–5 apply to all parameters and conditions
Burst C ycle Number and Burst Address Sequence
BL
16
BT
Seq
C3
0b
C2
0b
C1
0b
C0
0b
WC
Wrap
1
0
2
1
3
2
4
3
5
4
6
5
7
6
8
7
9
8
10
9
11
A
12
B
13
C
14
D
15
E
16
F
0b
0b
0b
1b
1b
1b
1b
0b
1b
1b
0b
0b
1b
1b
1b
0b
1b
0b
1b
0b
1b
0b
0b
0b
0b
0b
0b
0b
2
4
6
8
A
C
E
3
5
7
9
B
D
F
4
6
8
A
C
E
0
5
7
9
B
D
F
1
6
8
A
C
E
0
2
7
9
B
D
F
1
3
8
A
C
E
0
2
4
9
B
D
F
1
3
5
A
C
E
0
2
4
6
B
D
F
1
3
5
7
C
E
0
2
4
6
8
D
F
1
3
5
7
9
E
0
2
4
6
8
A
F
1
3
5
7
9
B
0
2
4
6
8
A
C
1
3
5
7
9
B
D
Int
X
X
X
0b
Illegal (not supported)
Any
X
X
X
0b
No
Illegal (not supported)
wrap
Notes:
1.
2.
3.
4.
5.
C0 input is not present on CA bus. It is implied zero.
For BL = 4, the burst address represents C[1:0].
For BL = 8, the burst address represents C[2:0].
For BL = 16, the burst address represents C[3:0].
For no-wrap, BL4, the burst must not cross the page boundary or the sub-page boun-
dary. The variable y can start at any address with C0 equal to 0, but must not start at any
address shown in the following table.
Table 16: No-Wrap Restrictions
Width
64Mb
128Mb/256Mb
512Mb/1Gb/2Gb
4Gb/8Gb
Cannot cross full-page boundary
x16
x32
FE, FF, 00, 01
7E, 7F, 00, 01
1FE, 1FF, 000, 001
FE, FF, 00, 01
3FE, 3FF, 000, 001
1FE, 1FF, 000, 001
7FE, 7FF, 000, 001
3FE, 3FF, 000, 001
Cannot cross sub-page boundary
x16
x32
7E, 7F, 80, 81
None
0FE, 0FF, 100, 101
None
1FE, 1FF, 200, 201
None
3FE, 3FF, 400, 401
None
Note:
1. No-wrap BL = 4 data orders shown are prohibited.
Table 17: MR2 Device Feature 2 (MA[7:0] = 02h)
OP7
OP6
OP5
OP4
OP3
OP2
OP1
OP0
RFU
RL and WL
PDF: 09005aef83f3f2eb
2gb_mobile_lpddr2_s4_g69a.pdf – Rev. N 3/12 EN
47
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PDF描述 |
|---|---|
| P51-300-G-H-I12-20MA-000-000 | SENSOR 300PSI M12-1.5 6G 4-20MA |
| REC5-0509SRW/H2/A/M/SMD | CONV DC/DC 5W 4.5-9VIN 09VOUT |
| P51-500-A-H-P-4.5OVP-000-000 | SENSOR 500PSI M12-1.5 6G .5-4.5V |
| P51-300-A-AD-D-20MA-000-000 | SENSOR 300PSI 7/16-20 UNF 4-20MA |
| P51-300-A-H-P-4.5OVP-000-000 | SENSOR 300PSI M12-1.5 6G .5-4.5V |
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