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参数资料
| 型号： | OR3L165B8PS208-DB |
| 厂商： | LATTICE SEMICONDUCTOR CORP |
| 元件分类： | FPGA |
| 英文描述： | FPGA, 1024 CLBS, 120000 GATES, 333 MHz, PQFP208 |
| 封装： | SQFP2-208 |
| 文件页数： | 13/77页 |
| 文件大小： | 873K |
| 代理商： | OR3L165B8PS208-DB |
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20
PD78052, 78053, 78054, 78055, 78056, 78058
Data Sheet U12327EJ5V0DS00
5.3 Timer/Event Counter
The
PD78052/78053/78054/78055/78056/78058 incorporate a 5-channel timer/event counter.
16-bit timer/event counter: 1 channel
8-bit timer/event counter:
2 channels
Watch timer:
1 channel
Watchdog timer:
1 channel
Table 5-2. Operation of Timer/Event Counter
16-Bit Timer/Event Counter 8-Bit Timer/Event Counter
Watch Timer
Watchdog Timer
Operation mode
Interval timer
1 channel
2 channels
1 channel
External event counter
1 channel
2 channels
—
Function
Timer output
1 output
2 outputs
—
PWM output
1 output
—
Pulse amplitude measurement
2 inputs
Square wave output
1 output
2 outputs
—
One-shot pulse output
1 output
—
Interrupt source
2
1
Test input
—
1 input
—
XT1/P07
XT2
X1
X2
fXT
fXX
Subsystem
clock
oscillator
Watch timer, clock
output function
Prescaler
Main system
clock
oscillator
Clock to peripheral
hardware
CPU clock
(fCPU)
Standby
controller
Wait
controller
To INTP0
sampling clock
2
fXX
22
fXX
23
fXX
24
fXX fXT
2
Prescaler
Selector
fX
2
STOP
Scaler
2
1
5.2 Clock Generator
Two types of generators, a main system clock generator and a subsystem clock generator, are available.
The minimum instruction execution time can also be changed.
0.4
s/0.8 s/1.6 s/3.2 s/6.4 s/12.8 s (@5.0 MHz operation with main system clock)
122
s (@32.768 kHz operation with subsystem clock)
Figure 5-1. Clock Generator Block Diagram
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
|---|---|
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