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参数资料
| 型号： | RM48L950PGET |
| 厂商： | TEXAS INSTRUMENTS INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, FLASH, 200 MHz, RISC MICROCONTROLLER, PQFP144 |
| 封装： | GREEN, PLASTIC, LQFP-144 |
| 文件页数： | 137/154页 |
| 文件大小： | 2807K |
| 代理商： | RM48L950PGET |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页当前第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页
PRODUCTPREVIEW
SPNS174
– SEPTEMBER 2011
4.13.2 On-Chip SRAM Auto Initialization
This microcontroller allows some of the on-chip memories to be initialized via the Memory Hardware
Initialization mechanism in the System module. This hardware mechanism allows an application to
program the memory arrays with error detection capability to a known state based on their error detection
scheme (odd/even parity or ECC).
The MINITGCR register enables the memory initialization sequence, and the MSINENA register selects
the memories that are to be initialized.
For more information on these registers see the RM48x Technical Reference Manual (SPNU481).
The mapping of the different on-chip memories to the specific bits of the MSINENA registers is shown in
Table 4-26. Memory Initialization
ADDRESS RANGE
CONNECTING MODULE
MSINENA REGISTER BIT #
BASE ADDRESS
ENDING ADDRESS
RAM (PD#1)
0x08000000
0x0800FFFF
0(1)
RAM (RAM_PD#1)
0x08010000
0x0801FFFF
0(1)
RAM (RAM_PD#2)
0x08020000
0x0802FFFF
0(1)
RAM (RAM_PD#3)
0x08030000
0x0803FFFF
0(1)
MIBSPI5 RAM
0xFF0A0000
0xFF0BFFFF
12(2)
MIBSPI3 RAM
0xFF0C0000
0xFF0DFFFF
11(2)
MIBSPI1 RAM
0xFF0E0000
0xFF0FFFFF
7(2)
DCAN3 RAM
0xFF1A0000
0xFF1BFFFF
10
DCAN2 RAM
0xFF1C0000
0xFF1DFFFF
6
DCAN1 RAM
0xFF1E0000
0xFF1FFFFF
5
MIBADC2 RAM
0xFF3A0000
0xFF3BFFFF
14
MIBADC1 RAM
0xFF3E0000
0xFF3FFFFF
8
N2HET2 RAM
0xFF440000
0xFF57FFFF
15
N2HET1 RAM
0xFF460000
0xFF47FFFF
3
HET TU2 RAM
0xFF4C0000
0xFF4DFFFF
16
HET TU1 RAM
0xFF4E0000
0xFF4FFFFF
4
DMA RAM
0xFFF80000
0xFFF80FFF
1
VIM RAM
0xFFF82000
0xFFF82FFF
2
USB Device RAM
RAM is not CPU-Addressable
n/a
Ethernet RAM (CPPI Memory
0xFC520000
0xFC521FFF
n/a
Slave)
(1)
The TCM RAM wrapper has separate control bits to select the RAM power domain that is to be auto-initialized.
(2)
The MibSPIx modules perform an initialization of the transmit and receive RAMs as soon as the multi-buffered mode is enabled. This is
independent of whether the application chooses to initialize the MibSPIx RAMs using the system module auto-initialization method.
Copyright
2011, Texas Instruments Incorporated
System Information and Electrical Specifications
83
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