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参数资料
| 型号： | ST72F652R4T1 |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP64 |
| 封装： | 14 X 14 MM, TQFP-64 |
| 文件页数： | 33/160页 |
| 文件大小： | 974K |
| 代理商： | ST72F652R4T1 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页当前第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页
ST7265
128/160
OPERATING CONDITIONS (Cont’d)
13.3.2 Operating Conditions with Low Voltage Detector (LVD)
Subject to general operating conditions for VDD,fOSC,and TA.
Figure 72. Low LVD Threshold Versus V
DD and f
OSC
Notes:
1. LVD typical data are based on TA=25°C. They are given only as design guidelines and are not tested.
2. Not tested, guaranteed by construction.
3. The VDD rise time condition is needed to insure a correct device power-on and LVD reset. Not tested in production.
13.3.3 Power Supply Manager Characteristics
Subject to general operating conditions for VDD,fOSC,and TA.
13.3.4 Storage Device Supply Characteristics
Subject to general operating conditions for VDD,fOSC,and TA.
Note: In Stand-alone mode VDDF must be connected to VDD
Symbol
Parameter
Condition s
Min
Typ 1)
Max
Unit
VIT+
Reset release threshold
(VDD rise)
2.4
2.5
2.6
V
VIT-
Reset generation threshold
(VDD fall)
2.2
2.3
2.4
Vhys
LVD voltage threshold hysteresis
VIT+-VIT-
100
200
mV
fCUTOFF
LVD filter cut-off frequency 2)
Not detected by the LVD
10
MHz.
VtPOR
VDD rise time
3)
0.1
10
ms
Symbol
Parameter
Condition s
Min
Typ 1)
Max
Unit
USBVIT+
Reset release threshold
(VDD rise)
3.75
3.85
3.95
V
USBVIT-
Reset generation threshold
(VDD fall)
3.55
3.65
3.75
USBVhys
USB voltage threshold hysteresis
USBVIT+-USBVIT-
100
200
mV
VPLLmin48
Minimum voltage required for stable
48MHz PLL operation (PLL locked)
3.7
V
VPLLmin40
Minimum voltage required for
40MHz PLL operation (PLL un-
locked)
3.4
V
VPLLmin24
Minimum voltage required for
24MHz PLL operation (PLL un-
locked)
3.0
V
Symbol
Parameter
Condition s
Min
Typ 1)
Max
Unit
VDDF
Voltage output for external storage
device
USB Mode: VSET[1:0]=00
2.4
2.5
2.6
V
01
2.7
2.8
2.9
10
3.0
3.1
3.2
11
3.3
3.4
3.5
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PDF描述 |
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