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参数资料
| 型号： | STPCE1EEBC |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 外设及接口 |
| 英文描述： | MULTIFUNCTION PERIPHERAL, PBGA388 |
| 封装： | PLASTIC, BGA-388 |
| 文件页数： | 33/87页 |
| 文件大小： | 1426K |
| 代理商： | STPCE1EEBC |
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Obsolete
Product(s)
- Obsolete
Product(s)
ELECTRICAL SPECIFICATIONS
Release 1.3 - January 29, 2002
39/87
This is preliminary information on a new product now in development or undergoing evaluation. Details are subject to change without notice.
4.5.2 RESET SEQUENCE
Figure 4-4 describes the reset sequence of the
STPC, also called warm reset.
The constraints on the strap options and the bus
activities are the same as for the cold reset.
The SYSRSTI# pulse duration must be long
enough to have all the strap options stabilized and
must be adjusted depending on resistor values.
It is mandatory to have a clean reset pulse without
glitches as the STPC could then sample invalid
strap option setting and enter into an umpredicta-
ble mode.
While SYSRSTI# is active, the PCI clock PLL runs
in open loop mode at a speed of few 100’s KHz.
Figure 4-4. Reset timing diagram
S trap O ptions
SYSRSTI#
SYSRSTO #
14 M Hz
VA LID CONFIG URATIO N
HCLK
PCI_CLK
2.3 m s
IS AC LK
1.6 V
MD[63:0]
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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