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参数资料
| 型号： | TMPR3904F |
| 英文描述： | MICROPROCESSOR|32-BIT|CMOS|QFP|208PIN|PLASTIC |
| 中文描述： | 微处理器| 32位|的CMOS | QFP封装| 208PIN |塑料 |
| 文件页数： | 152/230页 |
| 文件大小： | 1451K |
| 代理商： | TMPR3904F |
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TOSHIBA
TMPR3904F Rev. 2.0
144
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Dual address mode
The dual address mode is a mode that executes the transfer by the following two bus operations:
A read operation to output the address of the source device and to read the data from the
source device to take them in to the register (DHR) inside the DMAC.
A write operation to output the address of the destination device and to write the data of the
DHR to the destination device.
In the dual address mode, the following three kinds of transfers are possible:
Memory
→
Memory
Memory
→
I/O device
I/O device
→
Memory
The data transfer unit of the DMAC is the data amount that was designated in the TrSiz field of
the CCRn (32 or 16 bits). In the external transfer request, the data of the amount of the transfer
unit are transferred every time a transfer request is acknowledged. It is always a word (4 bytes,
32 bits) for the transfer of the internal transfer request.
In the dual address mode, the data of the amount of the data transfer unit are read in to the DHR
from the source device, and then the data are written in to the destination device.
A memory access occurs according to the data transfer unit. However, two 16-bit memory
accesses occur when the data transfer unit is 32 bits and 16-bit width memory is designated by
memory controller.
Separated from the data transfer unit, the bus width (the device port size) of the I/O device is
designated in the DPS field of the CCRn for the data transfer from a memory to an I/O or from
an I/O to a memory. The device port size is 32, 16, or 8 bits.
When the data transfer unit and the device port size are the same, the DMAC conducts one read
operation or write operation to the I/O device. The bus operation to a memory is always one
time; so, in this case, one transfer completes with two bus operations.
When the device port size is smaller than the data transfer unit, the DMAC conducts multiple
read operations or write operations to the I/O device. For example, to transfer data from an I/O
device whose data transfer unit is 32 bits and whose device post size is 8 bits to a memory, 8-bit
data are read out from the I/O device four times to be stored in the DHR; then the 32-bit data are
written in to the memory at one time (twice for 16-bit width memory).
The address and the value of BCRn are changed with the data transfer unit.
The set-up where the device port size is larger than the data transfer unit is inhibited.
The following table shows the summary:
相关PDF资料 |
PDF描述 |
|---|---|
| TMPR3907F | MICROPROCESSOR|32-BIT|CMOS|QFP|208PIN|PLASTIC |
| TMPR3912AU | 32-Bit Microprocessor |
| TMPR3912AU-92 | Microprocessor |
| TMPR3912U | 32-Bit Microprocessor |
| TMPR3912XB-75 | Microprocessor |
相关代理商/技术参数 |
参数描述 |
|---|---|
| TMPR3907F | 制造商:未知厂家 制造商全称:未知厂家 功能描述:MICROPROCESSOR|32-BIT|CMOS|QFP|208PIN|PLASTIC |
| TMPR3911 | 制造商:TOSHIBA 制造商全称:Toshiba Semiconductor 功能描述:32-Bit TX System RISC TX39 Family |
| TMPR3912 | 制造商:TOSHIBA 制造商全称:Toshiba Semiconductor 功能描述:32-Bit TX System RISC TX39 Family |
| TMPR3912AU | 制造商:未知厂家 制造商全称:未知厂家 功能描述:32-Bit Microprocessor |
| TMPR3912AU-92 | 制造商:未知厂家 制造商全称:未知厂家 功能描述:Microprocessor |
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