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参数资料
| 型号： | WJLXT386LEB2 |
| 厂商： | INTEL CORP |
| 元件分类： | 数字传输电路 |
| 英文描述： | DATACOM, PCM TRANSCEIVER, PQFP100 |
| 封装： | 14 X 14MM, ROHS COMPLIANT, LQFP-100 |
| 文件页数： | 42/86页 |
| 文件大小： | 1081K |
| 代理商： | WJLXT386LEB2 |
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QUAD T1/E1/J1 Transceiver — LXT386
Datasheet
47
Table 22. Automatic TAOS Select Register, ATS (0EH)
Bit1
Name
Function
3-0
ATS3-ATS0
Setting a bit to “1” enables automatic TAOS generation whenever a LOS condition is
detected in the respective transceiver.
7-4
-
Write “0” to these positions for normal operation.
1. On power-on reset the register is set to “0”.
2. This feature is not available in data recovery and line driver mode (MCLK= High and TCLK = High)
Table 23. Global Control Register, GCR (0FH)
Bit1
Name
Function
0
JASEL0
These bits determine the jitter attenuator position:
1
JASEL1
2JACF
This bit determines the jitter attenuator low limit 3dB corner frequency. Refer to the Jitter
Attenuator specifications for details (Table 41 on page 64).
3FIFO64
This bit determines the jitter attenuator FIFO depth:
0 = 32 bit
1 = 64 bit
4CODEN
This bit selects the zero suppression code for unipolar operation mode:
0 = B8ZS/HDB3 (T1/E1 respectively)
1 = AMI
5
CDIS
This bit controls enables/disables the short circuit protection feature:
0 = enabled
1 = disabled
6
RAISEN
This bit controls automatic AIS insertion in the receive path when LOS occurs:
0 = Receive AIS insertion disabled on LOS
1 = RPOS/RNEG = AIS on LOS
Note: this feature is not available in data recovery mode (MCLK=High). Disable AIS
interrupts when changing this bit value to prevent inadvertent interrupts.
7-
Reserved.
1. On power-on reset the register is set to “0”.
JASEL0
JASEL1
JA Position
1
0
Transmit Path
11
Receive Path
0
x
Disabled
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PDF描述 |
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