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参数资料
| 型号： | WJLXT386LEB2 |
| 厂商： | INTEL CORP |
| 元件分类： | 数字传输电路 |
| 英文描述： | DATACOM, PCM TRANSCEIVER, PQFP100 |
| 封装： | 14 X 14MM, ROHS COMPLIANT, LQFP-100 |
| 文件页数： | 49/86页 |
| 文件大小： | 1081K |
| 代理商： | WJLXT386LEB2 |
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QUAD T1/E1/J1 Transceiver — LXT386
Datasheet
53
5.4
JTAG Register Description
The following paragraphs describe each of the registers represented in Figure 15.
5.4.1
Boundary Scan Register (BSR)
The BSR is a shift register that provides access to all the digital I/O pins. The BSR is used to apply
and read test patterns to/from the board. Each pin is associated with a scan cell in the BSR register.
Bidirectional pins or tristatable pins require more than one position in the register. Table 1 shows
the BSR scan cells and their functions. Data into the BSR is shifted in LSB first.
Example 1. Boundary Scan Register – BSR (Sheet 1 of 3)
Bit #
Pin
Signal
I/O
Type
Bit
Symbol
Comments
0LOS3
O
LOS3
RNEG3
O
RNEG3
N/A
-
HIZ3
HIZ3 controls the RPOS3, RNEG3 and RCLK3 pins. Setting HIZ3 to “0”
enables output on the pins. Setting HIZ3 to “1” tristates the pins.
RPOS3
O
RPOS3
RCLK3
O
RCLK3
TNEG3
I
TNEG3
TPOS3
I
TPOS3
TCLK3
I
TCLK3
LOS2
O
LOS2
RNEG2
O
RNEG2
N/A
-
HIZ2
HIZ2 controls the RPOS2, RNEG2 and RCLK2 pins. Setting HIZ2 to “0”
enables output on the pins. Setting HIZ2 to “1” tristates the pins.
RPOS2
O
RPOS2
RCLK2
O
RCLK2
TNEG2
I
TNEG2
TPOS2
I
TPOS2
TCLK2
I
TCLK2
MCLK
I
MCLK
MODE
I
MODE
INT
O
INTRUPTB
N/A
-
SDORDYENB
SDORDYENB controls the ACK pin. Setting SDORDYENB to “0” enables
output on ACK pin. Setting SDORDYENB to “1” tristates the pin.
ACK
O
SDORDY
ALE
I
ALE
OE
I
OE
CLKE
I
CLKE
A0
I
A0
A1
I
A1
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PDF描述 |
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