参数资料
| 型号： | XCV300E-6FG456C |
| 厂商： | Xilinx Inc |
| 文件页数： | 78/233页 |
| 文件大小： | 0K |
| 描述： | IC FPGA 1.8V C-TEMP 456-FBGA |
| 产品变化通告： | FPGA Family Discontinuation 18/Apr/2011 |
| 标准包装： | 60 |
| 系列： | Virtex®-E |
| LAB/CLB数： | 1536 |
| 逻辑元件/单元数： | 6912 |
| RAM 位总计： | 131072 |
| 输入/输出数： | 312 |
| 门数： | 411955 |
| 电源电压： | 1.71 V ~ 1.89 V |
| 安装类型： | 表面贴装 |
| 工作温度： | 0°C ~ 85°C |
| 封装/外壳： | 456-BBGA |
| 供应商设备封装： | 456-FBGA |
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Virtex-E 1.8 V Field Programmable Gate Arrays
R
DS022-4 (v3.0) March 21, 2014
Module 4 of 4
Production Product Specification
83
— OBSOLETE — OBSOLETE — OBSOLETE — OBSOLETE —
52
1
B8
A8
√
VREF
53
1
A7
D9
√
-
54
1
B7
C8
3
-
55
1
A6
D8
3
-
56
1
B6
C7
√
VREF
57
1
A5
D7
√
-
58
1
B5
C6
5
VREF
59
1
A4
D6
5
-
60
1
D5
B4
√
CS
61
2
E3
C2
√
DIN, D0
62
2
D3
F3
6
-
63
2
D2
G4
4
VREF
64
2
G3
E2
4
-
65
2
H4
E1
6
VREF
66
2
H3
F2
√
-
67
2
J4
F1
4
-
68
2
J3
G2
6
-
69
2
G1
K4
√
VREF
70
2
H2
K3
√
-
71
2
H1
L4
7
VREF
72
2
J2
L3
4
-
73
2
J1
M3
√
VREF
74
2
K2
N4
√
-
75
2
K1
N3
4
-
76
2
L2
P4
√
D1
77
2
P3
L1
√
D2
78
2
R4
M2
6
-
79
2
R3
M1
4
-
80
2
T4
N2
4
-
81
2
N1
T3
6
VREF
82
2
P2
U5
√
-
83
2
P1
U4
4
-
84
2
R2
U3
6
-
85
2
V5
R1
√
D3
Table 23: FG680 Differential Pin Pair Summary
XCV600E, XCV1000E, XCV1600E, XCV2000E
Pair
Bank
P
Pin
N
Pin
AO
Other
Functions
86
2
V4
T2
√
-
87
2
V3
T1
7
-
88
2
W4
U2
4
-
89
2
W3
U1
√
VREF
90
2
AA3
V2
√
-
91
2
AA4
V1
4
VREF
92
2
AB2
W2
√
-
93
3
AB4
W1
4
VREF
94
3
AB5
Y2
√
-
95
3
AC2
Y1
√
VREF
96
3
AC3
AA1
4
-
97
3
AC4
AA2
7
-
98
3
AC5
AB1
√
-
99
3
AD3
AC1
√
VREF
100
3
AD1
AD4
6
-
101
3
AD2
AE3
4
-
102
3
AE1
AE4
√
-
103
3
AE2
AF3
6
VREF
104
3
AF4
AF1
4
-
105
3
AG3
AF2
4
-
106
3
AG4
AG1
6
-
107
3
AH3
AG2
√
D5
108
3
AH1
AJ2
√
VREF
109
3
AH2
AJ3
4
-
110
3
AJ1
AJ4
√
-
111
3
AK1
AK3
√
VREF
112
3
AK2
AK4
4
-
113
3
AL1
AL2
7
VREF
114
3
AM1
AL3
√
-
115
3
AM2
AL4
√
VREF
116
3
AM3
AN1
6
-
117
3
AM4
AP1
4
-
118
3
AN2
AP2
√
-
119
3
AN3
AR1
6
VREF
Table 23: FG680 Differential Pin Pair Summary
XCV600E, XCV1000E, XCV1600E, XCV2000E
Pair
Bank
P
Pin
N
Pin
AO
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