参数资料
| 型号： | XRT94L33IB-L |
| 厂商： | Exar Corporation |
| 文件页数： | 335/465页 |
| 文件大小： | 0K |
| 描述： | IC MAPPER DS3/E3/STS-1 504TBGA |
| 标准包装： | 24 |
| 应用： | 网络切换 |
| 接口： | 总线 |
| 电源电压： | 3.14 V ~ 3.47 V |
| 封装/外壳： | 504-LBGA |
| 供应商设备封装： | 504-TBGA（35x35） |
| 包装： | 托盘 |
| 安装类型： | 表面贴装 |
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XRT94L33
xr
Rev.1.2.0.
3-CHANNEL DS3/E3/STS-1 TO STS-3/STM-1 MAPPER IC DATA SHEET
40
AF19
AG21
AE17
STUFFCNTL_0/
TXHDLC_CLK_0/
STUFFCNTL_1/
TXHDLC_CLK_1/
STUFFCNTL_2/
TXHDLC_CLK_2/
I/O
TTL/CMOS
Transmit PLCP Processor Block – Nibble Trailer Stuff
Control Input pin/Transmit High-Speed HDLC Controller
Input Interface – Clock Output pin – Channel n:
The exact function of this input pin depends upon (1) whether
the XRT94L33 has been configured to operate in the ATM
UNI/PLCP Mode and (2) whether a given DS3/E3 Framer
block/Channel has been configured to operate in the “High-
Speed HDLC Controller” Mode, as described below.
ATM UNI Mode - STUFFCNT_n: Transmit PLCP Processor
block Nibble-Trailer Stuff Control Input pin – Channel n -
STUFFCNT_n:
This pin only functions in this particular role if the XRT94L33
has been configured to operate in the ATM UNI Mode. For
more information on this pin operating in this mode, please
see the XRT94L33 Pin Description for ATM UNI/PPP
Applications.
High-Speed HDLC Controller Mode – Transmit HDLC
Controller Input Interace Block - Clock output signal –
Channel n – TxHDLCClk_n:
This output signal functions as the “demand” clock for the
Transmit High-Speed HDLC Controller Input Interface block,
associated with the DS3/E3 Framer blocks.
Whenever the
user pulls the “Snd_Msg_n” input pin “high” then the Transmit
High-Speed HDLC Controller block will begin to sample and
latch the contents of the “TxHDLCDat[7:0] input pins upon the
falling edge of this clock signal.
The user is advised to
configure their terminal equipment circuitry to output (or place)
data onto the “TxHDLCDat[7:0] bus upon the rising edge of
this clock signal.
Since the Transmit HDLC Controller block is sampling and
latching 8-bits of data at a given time, it may be assumed that
the frequency of the TxHDLC_CLK_n output signal is either
34.368MHz/8 or 44.736MHz/8. In general, this presumption is
true. However, because the Transmit HDLC Controller block
is also performing “Zero-Stuffing” of the user data that it
accepts from the Terminal Equipment, the frequency of this
signal may be slower.
Note:
The user should tie this pin to GND if the DS3/E3
Framer block has NOT been configured to operate
in the “High-Speed HDLC Controller” Mode.
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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| XRT94L43A | 制造商:EXAR 制造商全称:EXAR 功能描述:SONET/SDH OC-12 TO 12XDS3/E3 MAPPER |
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