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参数资料
| 型号： | ZL2008ALAFT |
| 厂商： | Intersil |
| 文件页数： | 6/42页 |
| 文件大小： | 0K |
| 描述： | IC REG CTRLR BUCK PWM VM 36-QFN |
| 标准包装： | 100 |
| PWM 型： | 电压模式 |
| 输出数： | 1 |
| 频率 - 最大： | 1.4MHz |
| 占空比： | 95% |
| 电源电压： | 3 V ~ 5.5 V |
| 降压： | 是 |
| 升压： | 无 |
| 回扫： | 无 |
| 反相： | 无 |
| 倍增器： | 无 |
| 除法器： | 无 |
| Cuk： | 无 |
| 隔离： | 无 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 36-VFQFN 裸露焊盘 |
| 包装： | 带卷 (TR) |
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ZL2008
Electrical Specifications
V DD = 12V, T A = -40°C to +85°C unless otherwise noted. Typical values are at T A = +25°C. Boldface limits apply
over the operating temperature range, -40°C to +85°C. (Continued)
MIN
MAX
PARAMETER
CONDITIONS
(Note 14)
TYP
(Note 14)
UNIT
Fault Protection Characteristics
UVLO Threshold Range
UVLO Set-point Accuracy
UVLO Hysteresis
Configurable via I 2 C/SMBus
Factory default
2.85
-150
–
–
–
3
16
150
–
V
mV
%
UVLO Delay
Configurable via I 2 C/SMBus
0
–
–
–
100
2.5
%
μs
Power Good V OUT Threshold
Power Good V OUT Hysteresis
Power Good Delay
VSEN Undervoltage Threshold
VSEN Overvoltage Threshold
Factory default
Factory default
Using pin-strap or resistor (Note 11)
Configurable via I 2 C/SMBus
Factory default
Configurable via I 2 C/SMBus
Factory default
–
–
0
0
–
0
–
90
5
–
–
85
–
115
–
–
200
500
–
110
–
% V OUT
%
ms
s
% V OUT
% V OUT
% V OUT
VSEN Undervoltage Hysteresis
Configurable via I 2 C/SMBus
0
–
–
5
115
–
% V OUT
% V OUT
VSEN Undervoltage/Overvoltage
Factory default
–
16
–
μs
Fault Response Time
Current Limit Set-point Accuracy
Configurable via
I 2 C/SMBus
5
–
–
±10
60
–
μs
% FS
(V OUT Referenced)
(Note 12)
Current Limit Set-point Accuracy
–
±10
–
% FS
(Ground Referenced)
(Note 12)
Current Limit Protection Delay
Factory default
Configurable via I 2 C/SMBus
–
1
5
–
–
32
t SW
(Note 13)
t SW
(Note 13)
Temperature Compensation of
Current Limit Protection Threshold
Factory default
Configurable via I 2 C/SMBus
100
4400
12700
ppm/°C
Thermal Protection Threshold
(Junction Temperature)
Thermal Protection Hysteresis
Factory default
Configurable via I 2 C/SMBus
–
-40
–
125
–
15
–
125
–
°C
°C
°C
NOTES:
5. Does not include margin limits.
6. Percentage of Full Scale (FS) with temperature compensation applied.
7. V OUT measured at the termination of the VSEN+ and VSEN-sense points.
8. The device requires a delay period following an enable signal and prior to ramping its output. Precise timing mode limits this delay period to approx
2ms, where in normal mode it may vary up to 4ms. Current Share member minimum delay is 5ms. Current share reference must be 10ms greater
than member delay.
9. Precise ramp timing mode is only valid when using EN pin to enable the device rather than PMBus enable.
10. The devices may require up to a 4ms delay following the assertion of the enable signal (normal mode) or following the de-assertion of the enable
signal.
11. Factory default Power Good delay is set to the same value as the soft-start ramp time.
12. Percentage of Full Scale (FS) with temperature compensation applied
13. t SW = 1/f SW , where f SW is the switching frequency.
14. Compliance to datasheet limits is assured by one or more methods: production test, characterization and/or design.
15. Nominal capacitance of logic pins is 5pF.
6
FN6859.4
April 29, 2011
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