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参数资料
| 型号： | ZL2008ALAFT |
| 厂商： | Intersil |
| 文件页数： | 8/42页 |
| 文件大小： | 0K |
| 描述： | IC REG CTRLR BUCK PWM VM 36-QFN |
| 标准包装： | 100 |
| PWM 型： | 电压模式 |
| 输出数： | 1 |
| 频率 - 最大： | 1.4MHz |
| 占空比： | 95% |
| 电源电压： | 3 V ~ 5.5 V |
| 降压： | 是 |
| 升压： | 无 |
| 回扫： | 无 |
| 反相： | 无 |
| 倍增器： | 无 |
| 除法器： | 无 |
| Cuk： | 无 |
| 隔离： | 无 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 36-VFQFN 裸露焊盘 |
| 包装： | 带卷 (TR) |
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ZL2008
Pin Descriptions (Continued)
Type
Pin
21
22
23
24
25
26
27
Label
VR
GL
PGND
SW
GH
BST
VDD
(Note 16)
PWR
O
PWR
PWR
O
PWR
PWR
Description
Internal 5V reference used to power internal drivers.
Low side FET gate drive.
Power ground. Connect to low impedance ground plane.
Drive train switch node.
High-side FET gate drive.
High-side drive boost voltage.
Supply voltage.
(Note 18)
28
29
30
31
32
33
34
35
36
ePad
V25
XTEMP
DDC
MGN
CFG1
EN
PH_EN
CFG2
PG
SGND
PWR
I
I/O
I
I, M
I
I
I, M
O
PWR
Internal 2.5V reference used to power internal circuitry.
External temperature sensor input. Connect to external 2N3904 diode connected transistor.
Digital-DC Bus. (Open Drain) Interoperability between Zilker Labs devices.
Signal that enables margining of output voltage.
Configuration pin. Used to setup clock synchronization and sequencing.
Enable input (active high). Pull-up to enable PWM switching and pull-down to disable PWM switching.
Phase enable input (active high). Pull-up to enable phase and pull-down to disable phase for current sharing.
Configuration pin. Sets the phase offset (single-phase) or current sharing group position (multi-phase).
Power good output.
Exposed thermal pad. Common return for analog signals; internal connection to SGND. Connect to low
impedance ground plane.
NOTES:
16. I = Input, O = Output, PWR = Power or Ground. M = Multi-mode pins. Please refer to “Multi-mode Pins” on page 12.
17. The SYNC pin can be used as a logic pin, a clock input or a clock output.
18. V DD is measured internally and the value is used to modify the PWM loop gain.
8
FN6859.4
April 29, 2011
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