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参数资料
| 型号： | ADAU1445YSVZ-3A-RL |
| 厂商： | Analog Devices Inc |
| 文件页数： | 25/92页 |
| 文件大小： | 0K |
| 描述： | IC SIGMADSP 175MHZ 100TQFP |
| 标准包装： | 1,000 |
| 系列： | SigmaDSP® |
| 类型： | 音频处理器 |
| 应用： | 车载音频 |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 100-TQFP 裸露焊盘 |
| 供应商设备封装： | 100-TQFP-EP（14x14） |
| 包装： | 带卷 (TR) |
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ADAU1445/ADAU1446
Rev. A | Page 31 of 92
Serial Audio Data Timing Diagrams
MSB
LEFT CHANNEL
LSB
MSB
RIGHT CHANNEL
LSB
1/FS
0
76
96
-0
21
LRCLKx
BCLKx
SDATA_INx,
SDATA_OUTx
Figure 22. I2S Mode—16 Bits to 24 Bits per Channel
LEFT CHANNEL
MSB
LSB
MSB
RIGHT CHANNEL
LSB
1/FS
0
76
96
-0
22
LRCLKx
BCLKx
SDATA_INx,
SDATA_OUTx
Figure 23. Left-Justified Mode—16 Bits to 24 Bits per Channel
LRCLKx
BCLKx
LEFT CHANNEL
MSB
LSB
MSB
RIGHT CHANNEL
LSB
1/FS
07
69
6-
02
3
SDATA_INx,
SDATA_OUTx
Figure 24. Right-Justified Mode—16 Bits to 24 Bits per Channel
LRCLKx
BCLKx
SDATA_INx,
SDATA_OUTx
SLOT 1
SLOT 4
SLOT 5
32 BCLKs
MSB
MSB – 1
MSB – 2
256 BCLKs
SLOT 2
SLOT 3
SLOT 6
SLOT 7
SLOT 8
LRCLK
BCLK
DATA
07
69
6-
02
4
Figure 25. TDM Mode
SLOT 0
SLOT 1
SLOT 2
SLOT 3
SLOT 4
SLOT 5
SLOT 6
SLOT 7
CH
0
MSB TDM
8TH
CH
32
BCLKs
MSB TDM
0
769
6-
0
25
LRCLKx
BCLKx
SDATA_INx,
SDATA_OUTx
Figure 26. TDM Mode with Pulse Frame Clock
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PDF描述 |
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