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参数资料
| 型号： | ADP1048ARQZ-R7 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 48/84页 |
| 文件大小： | 0K |
| 描述： | IC DGTL PFC CTRLR 24QSOP |
| 标准包装： | 1 |
| 模式： | 平均电流 |
| 频率 - 开关： | 30kHz ~ 400kHz |
| 电源电压： | 3 V ~ 3.6 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 24-SSOP（0.154"，3.90mm 宽） |
| 供应商设备封装： | 24-QSOP |
| 包装： | 标准包装 |
| 其它名称： | ADP1048ARQZ-R7DKR |
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ADP1047/ADP1048
Data Sheet
Bits
[5:3]
Bit Name
Retry setting
R/W
R/W
Description
Number of retry attempts following a fault condition. If the fault persists after the programmed
number of attempts, the output is disabled and remains off until the fault is cleared. A fault
condition can be cleared by a reset, a power-off/power-on sequence, or a loss of bias power. The
time between restart attempts is specified by Delay Time 2 (Bits[2:0]).
Bit 5
0
0
0
0
1
1
1
1
Bit 4
0
0
1
1
0
0
1
1
Bit 3
0
1
0
1
0
1
0
1
Number of Retries
0
1
2
3
4
5
6
Infinite
[2:0]
Delay times
R/W
Delay Time 1 is the delay before the device disables the output after a fault condition is detected.
Delay Time 2 is the time between restart attempts.
Bit 2
0
0
0
0
1
1
1
1
Bit 1
0
0
1
1
0
0
1
1
Bit 0
0
1
0
1
0
1
0
1
Delay Time 1
10 ms
20 ms
40 ms
80 ms
160 ms
320 ms
640 ms
1280 ms
Delay Time 2
252 ms
558 ms
924 ms
1260 ms
1596 ms
1932 ms
2268 ms
2604 ms
VOUT_OV_WARN_LIMIT REGISTER
This register sets the accurate overvoltage threshold measured at the PFC output that causes an overvoltage warning condition.
Table 29. Register 0x42—VOUT_OV_WARN_LIMIT
Bits
[15:11]
Bit Name
Exponent
R/W
R
Description
Return the exponent (N) used in VOUT linear mode format (X = Y × 2 N ). The exponent (N) is set in
the VOUT_MODE register (Register 0x20, Bits[2:0]). The exponent is in twos complement format.
[10:8]
[7:0]
High bits
Low byte
R/W
R/W
Mantissa high bits (Y[10:8]) used in VOUT linear mode format (X = Y × 2 N ).
Mantissa low byte (Y[7:0]) used in VOUT linear mode format (X = Y × 2 N ).
VOUT_UV_WARN_LIMIT REGISTER
This register sets the undervoltage threshold measured at the PFC output that causes an undervoltage warning condition.
Table 30. Register 0x43—VOUT_UV_WARN_LIMIT
Bits
[15:11]
Bit Name
Exponent
R/W
R
Description
Return the exponent (N) used in VOUT linear mode format (X = Y × 2 N ). The exponent (N) is set in
the VOUT_MODE register (Register 0x20, Bits[2:0]). The exponent is in twos complement format.
[10:8]
[7:0]
High bits
Low byte
R/W
R/W
Mantissa high bits (Y[10:8]) used in VOUT linear mode format (X = Y × 2 N ).
Mantissa low byte (Y[7:0]) used in VOUT linear mode format (X = Y × 2 N ).
VOUT_UV_FAULT_LIMIT REGISTER
This register sets the undervoltage threshold measured at the PFC output that causes an undervoltage fault condition.
Table 31. Register 0x44—VOUT_UV_FAULT_LIMIT
Bits
[15:11]
Bit Name
Exponent
R/W
R
Description
Return the exponent (N) used in VOUT linear mode format (X = Y × 2 N ). The exponent (N) is set in
the VOUT_MODE register (Register 0x20, Bits[2:0]). The exponent is in twos complement format.
[10:8]
[7:0]
High bits
Low byte
R/W
R/W
Mantissa high bits (Y[10:8]) used in VOUT linear mode format (X = Y × 2 N ).
Mantissa low byte (Y[7:0]) used in VOUT linear mode format (X = Y × 2 N ).
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