参数资料
| 型号： | ATMEGA103-6AI |
| 厂商： | Atmel |
| 文件页数： | 16/141页 |
| 文件大小： | 0K |
| 描述： | IC MCU 128K 6MHZ A/D IT 64TQFP |
| 产品培训模块： | megaAVR Introduction |
| 标准包装： | 90 |
| 系列： | AVR® ATmega |
| 核心处理器： | AVR |
| 芯体尺寸： | 8-位 |
| 速度： | 6MHz |
| 连通性： | SPI，UART/USART |
| 外围设备： | POR，PWM，WDT |
| 输入/输出数： | 32 |
| 程序存储器容量： | 128KB（64K x 16） |
| 程序存储器类型： | 闪存 |
| EEPROM 大小： | 4K x 8 |
| RAM 容量： | 4K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 4 V ~ 5.5 V |
| 数据转换器： | A/D 8x10b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 64-TQFP |
| 包装： | 托盘 |
| 配用： | ATSTK501-ND - ADAPTER KIT FOR 64PIN AVR MCU |
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112
ATmega103(L)
0945I–AVR–02/07
Parallel Programming
Characteristics
Figure 76. Parallel Programming Timing
Notes:
1. Use tWLWH_CE for Chip Erase and tWLWH_PFB for programming the fuse bits.
2. If tWLWH is held longer than tWLRH, no RDY/BSY pulse will be seen.
Table 41. Parallel Programming Characteristics T
A = 25°C ± 10%, VCC = 5V ± 10%
Symbol
Parameter
Min
Typ
Max
Units
VPP
Programming Enable Voltage
11.5
12.5
V
IPP
Programming Enable Current
250
A
tDVXH
Data and Control Valid before XTAL1 High
67
ns
tXHXL
XTAL1 Pulse Width High
67
ns
tXLDX
Data and Control Hold after XTAL1 Low
67
ns
tXLWL
XTAL1 Low to WR Low
67
ns
tBVXH
BS1 Valid before XTAL1 High
67
ns
tPHPL
PAGEL Pulse Width High
67
ns
tPLBX
BS1 Hold after PAGEL Low
67
ns
tPLWL
PAGEL Low to WR Low
67
ns
tBVWL
BS1 Valid to WR Low
67
ns
tRHBX
BS1 Hold after RDY/BSY High
67
ns
tWLWH
WR Pulse Width Low
67
ns
tWHRL
WR High to RDY/BSY Low
20
ns
tWLRH
WR Low to RDY/BSY High
0.5
0.7
0.9
ms
tXLOL
XTAL1 Low to OE Low
67
ns
tOLDV
OE Low to DATA Valid
20
ns
tOHDZ
OE High to DATA Tri-stated
20
ns
tWLWH_CE
WR Pulse Width Low for Chip Erase
5
10
15
ms
tWLWH_PFB
WR Pulse Width Low for Progr. the Fuse Bits
1.0
1.5
1.8
ms
Data & Contol
(DATA, XA0/1, BS1)
DATA
W
rite
Read
XTAL1
t
XHXL
t
WLWH
t
DVXH
t
XLOL
t
OLDV
t
XLDX
t
PLWL
t
WHRL
t
WLRH
WR
RDY/BSY
OE
PAGEL
t
PHPL
t
PLBX
t
BVXH
t
XLWL
t
RHBX
t
OHDZ
t
BVWL
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