参数资料
| 型号： | ATMEGA103-6AI |
| 厂商： | Atmel |
| 文件页数： | 27/141页 |
| 文件大小： | 0K |
| 描述： | IC MCU 128K 6MHZ A/D IT 64TQFP |
| 产品培训模块： | megaAVR Introduction |
| 标准包装： | 90 |
| 系列： | AVR® ATmega |
| 核心处理器： | AVR |
| 芯体尺寸： | 8-位 |
| 速度： | 6MHz |
| 连通性： | SPI，UART/USART |
| 外围设备： | POR，PWM，WDT |
| 输入/输出数： | 32 |
| 程序存储器容量： | 128KB（64K x 16） |
| 程序存储器类型： | 闪存 |
| EEPROM 大小： | 4K x 8 |
| RAM 容量： | 4K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 4 V ~ 5.5 V |
| 数据转换器： | A/D 8x10b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 64-TQFP |
| 包装： | 托盘 |
| 配用： | ATSTK501-ND - ADAPTER KIT FOR 64PIN AVR MCU |
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122
ATmega103(L)
0945I–AVR–02/07
Figure 79. External RAM Timing
External Clock Drive
Waveforms
Figure 80. External Clock Drive Waveforms
Note:
See “External Data Memory Timing” on page 120. for a description of how the duty cycle
influences the timing for the external Data memory.
System Clock
ALE
WR
RD
Data / Address [7..0]
Address [15..8]
Address
T1
T2
T3
T4
Prev. Address
1
0
4
213
3a
5
Note: Clock cycle T3 is only present when external SRAM Wait State is enabled.
10
12
14
15
11
8
9
16
7
6
3b
Data
Wr
ite
Read
Addr.
Table 49. External Clock Drive
Symbol
Parameter
VCC = 2.7V to 3.6V
VCC = 4.0V to 5.5V
Units
1/tCLCL
Oscillator Frequency
0.0
4.0
0.0
6.0
MHz
tCLCL
Clock Period
250.0
167.0
ns
tCHCX
High Time
100.0
67.0
ns
tCLCX
Low Time
100.0
67.0
ns
tCLCH
Rise Time
1.6
0.5
s
tCHCL
Fall Time
1.6
0.5
s
VIL1
VIH1
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