参数资料
| 型号： | ATMEGA103-6AI |
| 厂商： | Atmel |
| 文件页数： | 69/141页 |
| 文件大小： | 0K |
| 描述： | IC MCU 128K 6MHZ A/D IT 64TQFP |
| 产品培训模块： | megaAVR Introduction |
| 标准包装： | 90 |
| 系列： | AVR® ATmega |
| 核心处理器： | AVR |
| 芯体尺寸： | 8-位 |
| 速度： | 6MHz |
| 连通性： | SPI，UART/USART |
| 外围设备： | POR，PWM，WDT |
| 输入/输出数： | 32 |
| 程序存储器容量： | 128KB（64K x 16） |
| 程序存储器类型： | 闪存 |
| EEPROM 大小： | 4K x 8 |
| RAM 容量： | 4K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 4 V ~ 5.5 V |
| 数据转换器： | A/D 8x10b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 64-TQFP |
| 包装： | 托盘 |
| 配用： | ATSTK501-ND - ADAPTER KIT FOR 64PIN AVR MCU |
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33
ATmega103(L)
0945I–AVR–02/07
Timer/Counter Interrupt Mask
Register – TIMSK
Bit 7 – OCIE2: Timer/Counter2 Output Compare Interrupt Enable
When the OCIE2 bit is set (one) and the I-bit in the Status Register is set (one), the
Timer/Counter2 Compare Match interrupt is enabled. The corresponding interrupt (at
vector $0012) is executed if a compare match in Timer/Counter2 occurs, i.e., when the
OCF2 bit is set in the Timer/Counter Interrupt Flag Register (TIFR).
Bit 6 – TOIE2: Timer/Counter2 Overflow Interrupt Enable
When the TOIE2 bit is set (one) and the I-bit in the Status Register is set (one), the
Timer/Counter2 Overflow interrupt is enabled. The corresponding interrupt (at vector
$0014) is executed if an overflow in Timer/Counter2 occurs, i.e., when the TOV2 bit is
set in the Timer/Counter Interrupt Flag Register (TIFR).
Bit 5 – TICIE1: Timer/Counter1 Input Capture Interrupt Enable
When the TICIE1 bit is set (one) and the I-bit in the Status Register is set (one), the
Timer/Counter1 Input Capture Event interrupt is enabled. The corresponding interrupt
(at vector $0016) is executed if a capture-triggering event occurs on pin 29, PD4(IC1),
i.e., when the ICF1 bit is set in the Timer/Counter Interrupt Flag Register.
Bit 4 – OCE1A: Timer/Counter1 Output Compare A Match Interrupt Enable
When the OCIE1A bit is set (one) and the I-bit in the Status Register is set (one), the
Timer/Counter1 Compare A Match interrupt is enabled. The corresponding interrupt (at
vector $0018) is executed if a Compare A Match in Timer/Counter1 occurs, i.e., when
the OCF1A bit is set in the Timer/Counter Interrupt Flag Register.
Bit 3 – OCIE1B: Timer/Counter1 Output Compare B Match Interrupt Enable
When the OCIE1B bit is set (one) and the I-bit in the Status Register is set (one), the
Timer/Counter1 Compare B Match interrupt is enabled. The corresponding interrupt (at
vector $001A) is executed if a Compare B Match in Timer/Counter1 occurs, i.e., when
the OCF1B bit is set in the Timer/Counter Interrupt Flag Register.
Bit 2 – TOIE1: Timer/Counter1 Overflow Interrupt Enable
When the TOIE1 bit is set (one) and the I-bit in the Status Register is set (one), the
Timer/Counter1 Overflow interrupt is enabled. The corresponding interrupt (at vector
$001C) is executed if an overflow in Timer/Counter1 occurs, i.e., when the TOV1 bit is
set in the Timer/Counter Interrupt Flag Register.
Bit 1 – OCIE0: Timer/Counter0 Output Compare Interrupt Enable
When the OCIE0 bit is set (one) and the I-bit in the Status Register is set (one), the
Timer/Counter0 Compare Match interrupt is enabled. The corresponding interrupt (at
vector $001E) is executed if a compare match in Timer/Counter0 occurs, i.e., when the
OCF0 bit is set in the Timer/Counter Interrupt Flag Register.
Bit
7
6
5
4
3
2
1
0
$37 ($57)
OCIE2
TOIE2
TICIE1
OCIE1A
OCIE1B
TOIE1
OCIE0
TOIE0
TIMSK
Read/Write
R/W
Initial Value
0
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PDF描述 |
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