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参数资料
| 型号： | CLRC63201T |
| 厂商： | NXP Semiconductors N.V. |
| 元件分类： | 通信及网络 |
| 英文描述： | Multiple protocol contactless reader IC (MIFARE-I-CODE1) |
| 封装： | CLRC63201T/0FE<SOT287-1 (SO32)|<<http://www.nxp.com/packages/SOT287-1.html<1<week 5, 2005,; |
| 文件页数： | 74/126页 |
| 文件大小： | 719K |
| 代理商： | CLRC63201T |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页当前第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页
CLRC632_35
NXP B.V. 2009. All rights reserved.
Product data sheet
PUBLIC
Rev. 3.5 — 10 November 2009
073935
51 of 126
NXP Semiconductors
CLRC632
Multiple protocol contactless reader IC (MIFARE/I-CODE1)
10.5.1.3
FIFOData register
Input and output of the 64 byte FIFO buffer.
10.5.1.4
PrimaryStatus register
Bits relating to receiver, transmitter and FIFO buffer status ags.
Table 45.
FIFOData register (address: 02h) reset value: xxxx xxxxb, 05h bit allocation
Bit
7
6
5
4
3
2
1
0
Symbol
FIFOData[7:0]
Access
D
Table 46.
FIFOData register bit descriptions
Bit
Symbol
Description
7 to 0
FIFOData[7:0] data input and output port for the internal 64-byte FIFO buffer. The FIFO
buffer acts as a parallel in to parallel out converter for all data streams.
Table 47.
PrimaryStatus register (address: 03h) reset value: 0000 0101b, 05h bit allocation
Bit
7
6
5
4
3
2
1
0
Symbol
0
ModemState[2:0]
IRq
Err
HiAlert
LoAlert
Access
R
Table 48.
PrimaryStatus register bit descriptions
Bit
Symbol
Value Status
Description
7
0
-
reserved
6 to 4 ModemState[2:0]
shows the state of the transmitter and receiver
state machines:
000
Idle
neither the transmitter or receiver are operating;
neither of them are started or have input data
001
TxSOF
transmit start of frame pattern
010
TxData
transmit data from the FIFO buffer (or
redundancy CRC check bits)
011
TxEOF
transmit End Of Frame (EOF) pattern
100
GoToRx1
intermediate state 1; receiver starts
GoToRx2
intermediate state 2; receiver nishes
101
PrepareRx
waiting until the RxWait register time period
expires
110
AwaitingRx
receiver activated; waiting for an input signal on
pin RX
111
Receiving
receiving data
3
IRq
-
shows any interrupt source requesting attention
based on the InterruptEn register ag settings
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