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参数资料
| 型号： | CLRC63201T |
| 厂商： | NXP Semiconductors N.V. |
| 元件分类： | 通信及网络 |
| 英文描述： | Multiple protocol contactless reader IC (MIFARE-I-CODE1) |
| 封装： | CLRC63201T/0FE<SOT287-1 (SO32)|<<http://www.nxp.com/packages/SOT287-1.html<1<week 5, 2005,; |
| 文件页数： | 89/126页 |
| 文件大小： | 719K |
| 代理商： | CLRC63201T |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页当前第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页
CLRC632_35
NXP B.V. 2009. All rights reserved.
Product data sheet
PUBLIC
Rev. 3.5 — 10 November 2009
073935
65 of 126
NXP Semiconductors
CLRC632
Multiple protocol contactless reader IC (MIFARE/I-CODE1)
10.5.4.3
DecoderControl register
Controls decoder operation.
10.5.4.4
BitPhase register
Selects the bit-phase between transmitter and receiver clock.
Table 87.
DecoderControl register (address: 1Ah) reset value: 0000 1000b, 08h bit
allocation
Bit
7
6
5
4
3
2
1
0
Symbol
0
RxMultiple ZeroAfterColl
RxFraming[1:0]
RxInvert
0
RxCoding
Access
R/W
Table 88.
DecoderControl register bit descriptions
Bit
Symbol
Value
Description
7
0
-
this value must not be changed
6
RxMultiple
0
after receiving one frame, the receiver is deactivated
1
enables reception of more than one frame
5
ZeroAfterColl
1
any bits received after a bit-collision are masked to zero. This
helps to resolve the anti-collision procedure as dened in
ISO/IEC 14443 A
4 to 3 RxFraming[1:0]
00
I-CODE1
01
MIFARE or ISO/IEC 14443 A
10
ISO/IEC 15693
11
ISO/IEC 14443 B
2
RxInvert
0
modulation at the rst half-bit results in logic 1 (I-CODE1)
1
modulation at the rst half-bit results in logic 0 (ISO/IEC 15693)
1
0
-
this value must not be changed
0
RxCoding
0
Manchester encoding
1
BPSK encoding
Table 89.
BitPhase register (address: 1Bh) reset value: 1010 1101b, ADh bit allocation
Bit
7
6
5
4
3
2
1
0
Symbol
BitPhase[7:0]
Access
R/W
Table 90.
BitPhase register bit descriptions
Bit
Symbol
Description
7 to 0
BitPhase
denes the phase relationship between transmitter and receiver clock
Remark: The correct value of this register is essential for proper
operation.
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