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参数资料
| 型号： | CLRC63201T |
| 厂商： | NXP Semiconductors N.V. |
| 元件分类： | 通信及网络 |
| 英文描述： | Multiple protocol contactless reader IC (MIFARE-I-CODE1) |
| 封装： | CLRC63201T/0FE<SOT287-1 (SO32)|<<http://www.nxp.com/packages/SOT287-1.html<1<week 5, 2005,; |
| 文件页数： | 96/126页 |
| 文件大小： | 719K |
| 代理商： | CLRC63201T |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页当前第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页
CLRC632_35
NXP B.V. 2009. All rights reserved.
Product data sheet
PUBLIC
Rev. 3.5 — 10 November 2009
073935
71 of 126
NXP Semiconductors
CLRC632
Multiple protocol contactless reader IC (MIFARE/I-CODE1)
10.5.6 Page 5: FIFO, timer and IRQ pin conguration
10.5.6.1
Page register
Selects the page register; see Section 10.5.1.1 “Page register” on page 50.
10.5.6.2
FIFOLevel register
Denes the levels for FIFO underow and overow warning.
10.5.6.3
TimerClock register
Selects the divider for the timer clock.
Table 112. FIFOLevel register (address: 29h) reset value: 0000 1000b, 08h bit allocation
Bit
7
6
5
4
3
2
1
0
Symbol
00
WaterLevel[5:0]
Access
R/W
Table 113. FIFOLevel register bit descriptions
Bit
Symbol
Description
7 to 6 00
these values must not be changed
5 to 0 WaterLevel[5:0] denes, the warning level of a FIFO buffer overow or underow:
HiAlert is set to logic 1 if the remaining FIFO buffer space is equal to,
or less than, WaterLevel[5:0] bits in the FIFO buffer.
LoAlert is set to logic 1 if equal to, or less than, WaterLevel[5:0] bits in
the FIFO buffer.
Table 114. TimerClock register (address: 2Ah) reset value: 0000 0111b, 07h bit allocation
Bit
7
6
5
4
3
2
1
0
Symbol
00
TAutoRestart
TPreScaler[4:0]
Access
RW
Table 115. TimerClock register bit descriptions
Bit
Symbol
Value
Function
7 to 6
00
-
these values must not be changed
5
TAutoRestart
1
the timer automatically restarts its countdown from the
TReloadValue[7:0] instead of counting down to zero
0
the timer decrements to zero and register InterruptIrq
TimerIRq bit is set to logic 1
4 to 0
TPreScaler[4:0]
-
denes the timer clock frequency (fTimerClock). The
TPreScaler[4:0] can be adjusted from 0 to 21. The following
formula is used to calculate the TimerClock frequency
(fTimerClock):
fTimerClock = 13.56 MHz / 2TPreScaler [MHz]
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