参数资料
| 型号： | CORE8051-AR |
| 厂商： | Microsemi SoC |
| 文件页数： | 19/41页 |
| 文件大小： | 0K |
| 描述： | IP MODULE CORE8051 |
| 标准包装： | 1 |
| 系列： | * |
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Core8051
Table 16 ? Core8051 Instruction Set in Hexadecimal Order (Continued)
Opcode
CAH
CBH
CCH
CDH
CEH
CFH
E0H
E1H
E2H
E3H
E4H
E5H
E6H
E7H
E8H
E9H
EAH
EBH
ECH
EDH
EEH
EFH
Mnemonic
XCH A,R2
XCH A,R3
XCH A,R4
XCH A,R5
XCH A,R6
XCH A,R7
MOVX A,@DPTR
AJMP addr11
MOVX A,@R0
MOVX A,@R1
CLR A
MOV A,direct
MOV A,@R0
MOV A,@R1
MOV A,R0
MOV A,R1
MOV A,R2
MOV A,R3
MOV A,R4
MOV A,R5
MOV A,R6
MOV A,R7
Opcode
DAH
DBH
DCH
DDH
DEH
DFH
F0H
F1H
F2H
F3H
F4H
F5H
F6H
F7H
F8H
F9H
FAH
FBH
FCH
FDH
FEH
FFH
Mnemonic
DJNZ R2,rel
DJNZ R3,rel
DJNZ R4,rel
DJNZ R5,rel
DJNZ R6,rel
DJNZ R7,rel
MOVX @DPTR,A
ACALL addr11
MOVX @R0,A
MOVX @R1,A
CPL A
MOV direct,A
MOV @R0,A
MOV @R1,A
MOV R0,A
MOV R1,A
MOV R2,A
MOV R3,A
MOV R4,A
MOV R5,A
MOV R6,A
MOV R7,A
1. The A5H opcode is not used by the original set of ASM51 instructions. In Core8051, this opcode is used to implement a trap instruction
for the OCI debugger logic.
Instruction Definitions
All Core8051 core instructions can be condensed to 53 basic operations, alphabetically ordered according to the
Table 17 ? PSW Flag Modification (CY, OV, AC)
Flag
Flag
Instruction
ADD
ADDC
SUBB
MUL
CY
X
X
X
0
OV
X
X
X
X
AC
X
X
X
–
Instruction
SETB C
CLR C
CPL C
ANL C,bit
CY
1
0
X
X
OV
–
–
–
–
AC
–
–
–
–
Note: In this table, 'X' denotes that the indicated flag is affected by the instruction and can be a logic 1 or logic 0, depending upon
specific calculations. If a particular box is blank, that flag is unaffected by the listed instruction.
v6.0
19
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