参数资料
| 型号： | CORE8051-AR |
| 厂商： | Microsemi SoC |
| 文件页数： | 26/41页 |
| 文件大小： | 0K |
| 描述： | IP MODULE CORE8051 |
| 标准包装： | 1 |
| 系列： | * |
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Core8051
Internal Data Memory Bus Cycle
Example bus cycles for internal data memory access are shown in Figure 16 and Figure 17 . Figure 16 shows an internal
data memory read cycle.
0ns
50ns
100ns
150ns
200ns
250ns
300ns
clk
ramaddr
ramoe
ramwe
ramdatao
Addr
Addr
ramdatai
max 1*Tclk
Data
max 1*Tclk
read sample
max 1*Tclk
Data
max 1*Tclk
read sample
Figure 16 ? Internal Data Memory Read Cycle
0ns
50ns
100ns
150ns
200ns
250ns
300ns
clk
ramaddr
ramoe
ramwe
ramcs
ramdatao
ramdatai
Addr
Data
write
sample
Addr
Data
write
sample
Figure 17 ? Internal Data Memory Write Cycle
26
v6.0
相关PDF资料 |
PDF描述 |
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参数描述 |
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