参数资料
| 型号： | DS3106LN+ |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 81/92页 |
| 文件大小： | 0K |
| 描述： | IC TIMING LINE CARD 64-LQFP |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 160 |
| 类型： | 定时卡 IC，多路复用器 |
| PLL： | 是 |
| 主要目的： | 以太网，SONET/SDH，Stratum，电信 |
| 输入： | CMOS，TTL |
| 输出： | CMOS，LVDS，LVPECL，TTL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:2 |
| 差分 - 输入:输出： | 无/是 |
| 频率 - 最大： | 312.5MHz |
| 电源电压： | 1.62 V ~ 1.98 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 64-LQFP |
| 供应商设备封装： | 64-LQFP（10x10） |
| 包装： | 托盘 |
| 产品目录页面： | 1429 (CN2011-ZH PDF) |
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DS3106
82
10.2 Input Clock Timing
Table 10-6. Input Clock Timing
(VDD = 1.8V ±10%; VDDIO = 3.3V ±5%, TA = -40°C to +85°C.)
PARAMETER
SYMBOL
CONDITIONS
MIN
TYP
MAX
UNITS
Input Clock Duty Cycle
30
70
%
10.3 Output Clock Timing
Table 10-7. Input Clock to Output Clock Delay
INPUT
FREQUENCY
OUTPUT
FREQUENCY
INPUT CLOCK EDGE TO
OUTPUT CLOCK EDGE
DELAY (ns)
8kHz
0
± 1.5
6.48MHz
0
± 1.5
19.44MHz
0
± 1.5
25.92MHz
0
± 1.5
38.88MHz
0
± 1.5
51.84MHz
0
± 1.5
77.76MHz
0
± 1.5
155.52MHz
0
± 1.5
Table 10-8. Output Clock Phase Alignment, Frame-Sync Alignment Mode
OUTPUT
FREQUENCY
MFSYNC FALLING EDGE TO OUTPUT
CLOCK FALLING EDGE DELAY (ns)
8kHz (FSYNC)
0
± 0.5
2kHz
0
± 0.5
8kHz
0
± 0.5
1.544MHz
0
± 1.25
2.048MHz
0
± 1.25
44.736MHz
-2.0
± 1.25
34.368MHz
-2.0
± 1.25
6.48MHz
-2.0
± 1.25
19.44MHz
-2.0
± 1.25
25.92MHz
-2.0
± 1.25
38.88MHz
-2.0
± 1.25
51.84MHz
-2.0
± 1.25
77.76MHz
-2.0
± 1.25
155.52MHz
-2.0
± 1.25
311.04MHz
-2.0
± 1.25
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
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