参数资料
| 型号： | DS32512N# |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 24/130页 |
| 文件大小： | 0K |
| 描述： | IC LIU DS3/E3/STS-1 484-BGA |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 60 |
| 类型： | 线路接口装置（LIU） |
| 规程： | DS3 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 484-BGA |
| 供应商设备封装： | 484-BGA（23x23） |
| 包装： | 管件 |
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DS32506/DS32508/DS32512
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5.5 Bit Error-Rate Tester (BERT) Features
One BERT per port
Software programmable for insertion toward the transmit line interface or the receive system interface
Generates and detects pseudo-random patterns of length 2
n - 1 (n = 1 to 32) and repetitive patterns from 1 to
32 bits in length
Large 24-bit error counter and 32-bit bit counter allows testing to proceed for long periods without host
intervention
Errors can be inserted in the generated BERT patterns for diagnostic purposes (single bit errors or specific bit-
error rates)
Pattern synchronization even in the presence of 10
-3 bit-error rate
5.6 Clock Adapter
Creates DS3, E3, STS-1, and/or telecom bus clocks from single input reference clock
Input reference clock can be DS3, E3, STS-1, 12.8MHz, 19.44MHz, 38.88MHz, or 77.76MHz
Use of common system timing frequencies such as 19.44MHz eliminates the need for any local oscillators,
reducing cost and board space
Very small jitter gain and intrinsic jitter generation
Derived clocks can be output for external system use
Transmit signals using CLAD clocks meet Telcordia (DS3) and ITU (E3) jitter and wander requirements
5.7 Parallel Microprocessor Interface Features
Multiplexed or nonmultiplexed 8- or 16-bit interface
Configurable for Intel mode (
Ready (RDY/ACK) handshake output signal
5.8 SPI Serial Microprocessor Interface Features
Operation up to 10Mbps
Burst mode for multibyte read and write accesses
Programmable clock polarity and phase
Half-duplex operation gives option to tie SDI and SDO together externally to reduce wire count
5.9 Miscellaneous Features
Global reset input pin
Global interrupt output pin
Two programmable I/O pins per port
5.10 Test Features
Five pin JTAG port
All functional pins are in-out pins in JTAG mode
Standard JTAG instructions: SAMPLE/PRELOAD, BYPASS, EXTEST, CLAMP, HIGHZ, IDCODE
HIZ pin to force all digital output and I/O pins into a high-impedance state
TEST pin for manufacturing test modes
5.11 Loopback Features
Analog local loopback—ALB (transmit line output to receive line input)
Diagnostic local loopback—DLB (transmit framer interface to receive framer interface)
Line loopback—LLB (receive clock and data recover to transmit waveshaping)
Optional AIS generation on the line side of the loopback during diagnostic loopback
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PDF描述 |
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| DS32512W | 功能描述:网络控制器与处理器 IC RoHS:否 制造商:Micrel 产品:Controller Area Network (CAN) 收发器数量: 数据速率: 电源电流（最大值）:595 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:PBGA-400 封装:Tray |
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