参数资料
| 型号： | DS32512N# |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 96/130页 |
| 文件大小： | 0K |
| 描述： | IC LIU DS3/E3/STS-1 484-BGA |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 60 |
| 类型： | 线路接口装置（LIU） |
| 规程： | DS3 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 484-BGA |
| 供应商设备封装： | 484-BGA（23x23） |
| 包装： | 管件 |
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DS32506/DS32508/DS32512
68 of 130
Register Name:
PORT.SR
Register Description:
Port Status Register
Register Address:
n * 80h + 18h
Bit #
15
14
13
12
11
10
9
8
Name
—
Default
—
Bit #
7
6
5
4
3
2
1
0
Name
—
PMS
Default
—
0
Bit 0: Performance Monitoring Update Status (PMS).
This bit is set when the PMS bits are set in all of the port
functional blocks that are configured for port-level update control (i.e., all blocks that have PMUM = 1). Blocks that
have PMUM = 0 have no effect on this bit. In port-level software update mode, the port update request bit
0 = The associated update request signal is low or not all register updates are completed.
1 = The requested performance register updates are all completed.
Register Name:
PORT.SRL
Register Description:
Port Status Register Latched
Register Address:
n * 80h + 1Ah
Bit #
15
14
13
12
11
10
9
8
Name
—
TCLKL
Bit #
7
6
5
4
3
2
1
0
Name
—
PMSL
Bit 8: Transmit Clock Activity Status Latched (TCLKL).
This bit is set when the signal on the TCLK pin used by
this port (TCLKn when TCC = 0, TCLK1 when TCC = 1) is active. When set, this bit causes an interrupt if interrupt
Bit 0: Performance Monitoring Update Status Latched (PMSL).
This bit is set when the PORT.SR:PMS status
bit changes from low to high. When set, this bit causes an interrupt if interrupt enables PORT.SRIE:PMSIE,
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PDF描述 |
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| DS32512+ | IC LIU DS3/E3/STS-1 484-BGA |
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相关代理商/技术参数 |
参数描述 |
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| DS32512W | 功能描述:网络控制器与处理器 IC RoHS:否 制造商:Micrel 产品:Controller Area Network (CAN) 收发器数量: 数据速率: 电源电流（最大值）:595 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:PBGA-400 封装:Tray |
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