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参数资料
| 型号： | DSPB56364AF100 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 74/148页 |
| 文件大小： | 0K |
| 描述： | IC DSP 24BIT AUD 100MHZ 100-LQFP |
| 标准包装： | 90 |
| 系列： | DSP56K/Symphony |
| 类型： | 音频处理器 |
| 接口： | 主机接口，I²C，SAI，SPI |
| 时钟速率： | 100MHz |
| 非易失内存： | ROM（24 kB） |
| 芯片上RAM： | 11.25kB |
| 电压 - 输入/输出： | 3.30V |
| 电压 - 核心： | 3.30V |
| 工作温度： | -40°C ~ 105°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 100-LQFP |
| 供应商设备封装： | 100-LQFP（14x14） |
| 包装： | 托盘 |
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External Memory Expansion Port (Port A)
DSP56364 Technical Data, Rev. 4.1
Freescale Semiconductor
3-15
Figure 3-9 SRAM Read Access
118
TA setup before RD or WR deassertion4
0.25
× T
C + 2.0
4.5
—
ns
119
TA hold after RD or WR deassertion
0
—
ns
1 All timings for 100 MHz are measured from 0.5 Vcc to .05 Vcc
2 WS is the number of wait states specified in the BCR.
3 Timings 100, 107 are guaranteed by design, not tested.
4 In the case of TA negation: timing 118 is relative to the deassertion edge of RD or WR were TA to remain active.
Table 3-8 SRAM Read and Write Accesses1 (continued)
No.
Characteristics
Symbol
Expression2
Min
Max
Unit
A0–A17
RD
WR
D0–D7
AA0–AA1
115
105
106
113
104
116
117
100
AA0468
TA
119
Data
In
118
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PDF描述 |
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