参数资料
型号: DSPB56367AG150
厂商: Freescale Semiconductor
文件页数: 47/100页
文件大小: 0K
描述: IC DSP 24BIT 150MHZ 144-LQFP
标准包装: 60
系列: DSP56K/Symphony
类型: 音频处理器
接口: 主机接口,I²C,SAI,SPI
时钟速率: 150MHz
非易失内存: ROM(240 kB)
芯片上RAM: 69kB
电压 - 输入/输出: 3.30V
电压 - 核心: 1.80V
工作温度: -40°C ~ 95°C
安装类型: 表面贴装
封装/外壳: 144-LQFP
供应商设备封装: 144-LQFP(20x20)
包装: 托盘
External Memory Expansion Port (Port A)
DSP56367 Technical Data, Rev. 2.1
3-26
Freescale Semiconductor
183
WR assertion to RAS deassertion
tRWL
15.75
× TC 4.3
153.2
ns
184
WR assertion to CAS deassertion
tCWL
14.25
× TC 4.3
138.2
ns
185
Data valid to CAS assertion (write)
tDS
8.75
× TC 4.0
83.5
ns
186
CAS assertion to data not valid (write)
tDH
6.25
× TC 4.0
58.5
ns
187
RAS assertion to data not valid (write)
tDHR
9.75
× TC 4.0
93.5
ns
188
WR assertion to CAS assertion
tWCS
9.5
× TC 4.3
90.7
ns
189
CAS assertion to RAS assertion (refresh)
tCSR
1.5
× TC 4.0
11.0
ns
190
RAS deassertion to CAS assertion (refresh)
tRPC
4.75
× TC 4.0
43.5
ns
191
RD assertion to RAS deassertion
tROH
15.5
× TC 4.0
151.0
ns
192
RD assertion to data valid
tGA
14
× TC 5.7
134.3
ns
193
RD deassertion to data not valid5
tGZ
0.0
ns
194
WR assertion to data active
0.75
× TC – 1.5
6.0
ns
195
WR deassertion to data high impedance
0.25
× TC
—2.5
ns
1 The number of wait states for an out-of-page access is specified in the DCR.
2 The refresh period is specified in the DCR.
3 An expression is used to compute the maximum or minimum value listed (or both if the expression includes ±).
4 Either t
RCH or tRRH must be satisfied for read cycles.
5 RD deassertion always occurs after CAS deassertion; therefore, the restricted timing is t
OFF and not tGZ.
Table 3-13 DRAM Out-of-Page and Refresh Timings, Fifteen Wait States1, 2 (continued)
No.
Characteristics
Symbol
Expression3
100 MHz
Unit
Min
Max
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