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参数资料
| 型号： | DSPB56367AG150 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 53/100页 |
| 文件大小： | 0K |
| 描述： | IC DSP 24BIT 150MHZ 144-LQFP |
| 标准包装： | 60 |
| 系列： | DSP56K/Symphony |
| 类型： | 音频处理器 |
| 接口： | 主机接口，I²C，SAI，SPI |
| 时钟速率： | 150MHz |
| 非易失内存： | ROM（240 kB） |
| 芯片上RAM： | 69kB |
| 电压 - 输入/输出： | 3.30V |
| 电压 - 核心： | 1.80V |
| 工作温度： | -40°C ~ 95°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 144-LQFP |
| 供应商设备封装： | 144-LQFP（20x20） |
| 包装： | 托盘 |
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Parallel Host Interface (HDI08) Timing
DSP56367 Technical Data, Rev. 2.1
3-32
Freescale Semiconductor
332
HCS assertion to output data valid
—
19.1
ns
333
HCS hold time after data strobe deassertion9
—0.0
—
ns
334
Address (AD7–AD0) setup time before HAS deassertion (HMUX=1)
—
4.7
—
ns
335
Address (AD7–AD0) hold time after HAS deassertion (HMUX=1)
—
3.3
—
ns
336
A10–A8 (HMUX=1), A2–A0 (HMUX=0), HR/W setup time before data
strobe assertion9
Read
Write
—0
4.7
—
ns
337
A10–A8 (HMUX=1), A2–A0 (HMUX=0), HR/W hold time after data strobe
deassertion9
—3.3
—
ns
338
Delay from read data strobe deassertion to host request assertion for “Last
TC
6.7
—
ns
339
Delay from write data strobe deassertion to host request assertion for “Last
Data Register” write5, 8, 10
2
× TC
13.4
—
ns
340
Delay from data strobe assertion to host request deassertion for “Last Data
—
19.1
ns
341
Delay from data strobe assertion to host request deassertion for “Last Data
—
300.0
ns
342
Delay from DMA HACK deassertion to HOREQ assertion
For “Last Data Register” read5
For “Last Data Register” write5
For other cases
2
× TC + 19.1
1.5
× TC + 19.1
32.5
29.2
0.0
—
ns
343
Delay from DMA HACK assertion to HOREQ deassertion
HROD = 05
—
20.2
ns
344
Delay from DMA HACK assertion to HOREQ deassertion for “Last Data
Register” read or write
—
300.0
ns
1 See Host Port Usage Considerations in the DSP56367 User’s Manual.
2 In the timing diagrams below, the controls pins are drawn as active low. The pin polarity is programmable.
3 V
CC = 1.8 V ± 5%; TJ = –40°C to +95°C, CL = 50 pF
4 The read data strobe is HRD in the dual data strobe mode and HDS in the single data strobe mode.
5 The “last data register” is the register at address $7, which is the last location to be read or written in data transfers.
6 This timing is applicable only if a read from the “last data register” is followed by a read from the RXL, RXM, or RXH registers
without first polling RXDF or HREQ bits, or waiting for the assertion of the HOREQ signal.
7 This timing is applicable only if two consecutive reads from one of these registers are executed.
8 The write data strobe is HWR in the dual data strobe mode and HDS in the single data strobe mode.
Table 3-15
Host Interface (HDI08) Timing1, 2, 3 (continued)
No.
Characteristics
Expression
150 MHz
Unit
Min
Max
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参数描述 |
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| DSPB5636AG120 | 制造商:Freescale Semiconductor 功能描述: |
| DSPB56371AF150 | 功能描述:数字信号处理器和控制器 - DSP, DSC 150 MHZ VERSION DSPB371 RoHS:否 制造商:Microchip Technology 核心:dsPIC 数据总线宽度:16 bit 程序存储器大小:16 KB 数据 RAM 大小:2 KB 最大时钟频率:40 MHz 可编程输入/输出端数量:35 定时器数量:3 设备每秒兆指令数:50 MIPs 工作电源电压:3.3 V 最大工作温度:+ 85 C 封装 / 箱体:TQFP-44 安装风格:SMD/SMT |
| DSPB56371AF180 | 功能描述:数字信号处理器和控制器 - DSP, DSC BLANK ROM VERSION 56371 RoHS:否 制造商:Microchip Technology 核心:dsPIC 数据总线宽度:16 bit 程序存储器大小:16 KB 数据 RAM 大小:2 KB 最大时钟频率:40 MHz 可编程输入/输出端数量:35 定时器数量:3 设备每秒兆指令数:50 MIPs 工作电源电压:3.3 V 最大工作温度:+ 85 C 封装 / 箱体:TQFP-44 安装风格:SMD/SMT |
| DSPB56371AF180 | 制造商:Freescale Semiconductor 功能描述:Digital Signal Processor (DSP) IC |
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