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参数资料
| 型号： | M30240M5-XXXFP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, MROM, 12 MHz, MICROCONTROLLER, PQFP80 |
| 封装： | 0.80 MM PITCH, PLASTIC, QFP-80 |
| 文件页数： | 128/139页 |
| 文件大小： | 1453K |
| 代理商： | M30240M5-XXXFP |
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89
Mitsubishi microcomputers
M30240 Group
SINGLE-CHIP 16-BIT CMOS MICROCOMPUTER
Specifications REV. G
Specifications in this manual are tentative and subject to change
UART0 to UART2
1.2.23.1.1 Polarity select function
As shown in Figure 1.83, the CLK polarity select bit (bit 6 at addresses 03A416, 03AC16, 037C16) allows se-
lection of the polarity of the transfer clock.
Figure 1.83: Polarity of transfer clock
1.2.23.1.2 LSB first/MSB first select function
As shown in Figure 1.84, when the transfer format select bit (bit 7 at addresses 03A416, 03AC16, 037C16) =
“0”, the transfer format is “LSB first”; when the bit = “1”, the transfer format is “MSB first”.
Note: This applies CLK polarity select bit = “0”.
Figure 1.84: Transfer format
1.2.23.1.3 Transfer clock output from multiple pins function (UART1)
This function allows using two transfer clock output pins and choosing one of the two to output a clock by using
the CLK and CLKS select bit (bits 4 and 5 at address 03B016). See Figure 1.85. The multiple pins function is
valid only when the internal clock is selected for UART1. Note that when this function is selected, the UART1
CTS/RTS function cannot be used.
Figure 1.85: The transfer clock output from the multiple pins function usage
When CLK polarity select bit = “1”
Note 2: The CLK pin level when not
transferring data is “L”.
D1
D2
D3
D4
D5
D6
D7
D1
D2
D3
D4
D5
D6
D7
D0
TXDi
RXDi
CLKi
When CLK polarity select bit = “0”
Note 1: The CLK pin level when not
transferring data is “H”.
D1
D2
D3
D4
D5
D6
D7
D0
D1
D2
D3
D4
D5
D6
D7
D0
TXDi
RXDi
CLKi
LSB first
When transfer format select bit = “0”
D0
D0
D1
D2
D3
D4
D5
D6
D7
D1
D2
D3
D4
D5
D6
D7
TXDi
RXDi
CLKi
When transfer format select bit = “1”
D6
D5
D4
D3
D2
D1
D0
D7
D6
D5
D4
D3
D2
D1
D0
TXDi
RXDi
CLKi
MSB first
Microcomputer
TXD1 (P67)
CLKS1 (P64)
CLK1 (P65)
IN
CLK
IN
CLK
Note: This applies when the internal clock is selected and transmission
is performed only in clock synchronous serial I/O mode.
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PDF描述 |
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