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参数资料
| 型号： | PC28F256J3C-115 |
| 厂商： | Intel Corp. |
| 英文描述： | Intel StrataFlash Memory (J3) |
| 中文描述： | 英特尔StrataFlash存储器（J3） |
| 文件页数： | 49/72页 |
| 文件大小： | 905K |
| 代理商： | PC28F256J3C-115 |
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256-Mbit J3 (x8/x16)
Datasheet
49
13.4
Array Protection
The V
PEN
signal is a hardware mechanism to prohibit array alteration. When the V
PEN
voltage is
below the V
PENLK
voltage, array contents cannot be altered. To ensure a proper erase or program
operation, V
PEN
must be set to a valid voltage level. To determine the status of an erase or program
operation, poll the Status Register and analyze the bits.
6
Factory
1
0
0
0
0
1
0
0
0
7
Factory
1
0
0
0
0
1
0
0
1
8
User
1
0
0
0
0
1
0
1
0
9
User
1
0
0
0
0
1
0
1
1
A
User
1
0
0
0
0
1
1
0
0
B
User
1
0
0
0
0
1
1
0
1
C
User
1
0
0
0
0
1
1
1
0
D
User
1
0
0
0
0
1
1
1
1
E
User
1
0
0
0
1
0
0
0
0
F
User
1
0
0
0
1
0
0
0
1
NOTE:
All address lines not specified in the above table must be 0 when accessing the Protection Register,
i.e.g., A[MAX:9] = 0.
Table 21. Byte-Wide Protection Register Addressing (Sheet 2 of 2)
相关PDF资料 |
PDF描述 |
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| PC28F256J3C-125 | 制造商:INTEL 制造商全称:Intel Corporation 功能描述:Intel StrataFlash Memory (J3) |
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| PC28F256J3C-150 | 制造商:INTEL 制造商全称:Intel Corporation 功能描述:Intel StrataFlash Memory (J3) |
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