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参数资料
| 型号： | S1C17651B00E100 |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, FLASH, 2 MHz, RISC MICROCONTROLLER, PBGA |
| 文件页数： | 33/216页 |
| 文件大小： | 1784K |
| 代理商： | S1C17651B00E100 |
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15 UART
15-12
Seiko Epson Corporation
S1C17651 TECHNICAL MANUAL
UART Ch.x Transmit Data Register (UART_TXDx)
Register name Address
Bit
Name
Function
Setting
Init. R/W
Remarks
UART Ch.x
Transmit Data
Register
(UART_TXDx)
0x4101
(8 bits)
D7–0 TXD[7:0]
Transmit data
TXD7(6) = MSB
TXD0 = LSB
0x0 to 0xff (0x7f)
0x0 R/W
D[7:0]
TXD[7:0]: Transmit Data
Write transmit data to be set in the transmit data buffer. (Default: 0x0)
The UART starts transmitting when data is written to this register. Data written to TXD[7:0] is retained
until sent to the transmit data buffer.
Transmitting data from within the transmit data buffer generates a cause of transmit buffer empty inter-
rupt.
TXD7 (MSB) is invalid in 7-bit mode.
Serial converted data is output from the SOUTx pin beginning with the LSB, in which the bits set to 1
are output as High level and bits set to 0 as Low level signals.
This register can also be read.
UART Ch.x Receive Data Register (UART_RXDx)
Register name Address
Bit
Name
Function
Setting
Init. R/W
Remarks
UART Ch.x
Receive Data
Register
(UART_RXDx)
0x4102
(8 bits)
D7–0 RXD[7:0]
Receive data in the receive data
buffer
RXD7(6) = MSB
RXD0 = LSB
0x0 to 0xff (0x7f)
0x0
R Older data in the buf-
fer is read out first.
D[7:0]
RXD[7:0]: Receive Data
Data in the receive data buffer is read out in sequence, starting with the oldest. Received data is placed in
the receive data buffer. The receive data buffer is a 2-byte FIFO that allows proper data reception until it
fills, even if data is not read out. If the buffer is full and the shift register also contains received data, an
overrun error will occur, unless the data is read out before reception of the subsequent data starts.
The receive circuit includes two receive buffer status flags: RDRY/UART_STx register and RD2B/
UART_STx register. The RDRY flag indicates the presence of valid received data in the receive data
buffer, while the RD2B flag indicates the presence of two received data in the receive data buffer.
A receive buffer full interrupt occurs when the received data in the receive data buffer reaches the num-
ber specified by RBFI/UART_CTLx register.
0 is loaded into RXD7 in 7-bit mode.
Serial data input via the SINx pin is converted to parallel, with the initial bit as LSB, the High level bit
as 1, and the Low level bit as 0. This data is then loaded into the receive data buffer.
This register is read-only. (Default: 0x0)
UART Ch.x Mode Register (UART_MODx)
Register name Address
Bit
Name
Function
Setting
Init. R/W
Remarks
UART Ch.x
Mode Register
(UART_MODx)
0x4103
(8 bits)
D7–5 –
reserved
–
0 when being read.
D4
CHLN
Character length select
1 8 bits
0 7 bits
0
R/W
D3
PREN
Parity enable
1 With parity
0 No parity
0
R/W
D2
PMD
Parity mode select
1 Odd
0 Even
0
R/W
D1
STPB
Stop bit select
1 2 bits
0 1 bit
0
R/W
D0
–
reserved
–
0 when being read.
D[7:5]
Reserved
D4
CHLN: Character Length Select Bit
Selects the serial transfer data length.
1 (R/W): 8 bits
0 (R/W): 7 bits (default)
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PDF描述 |
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