参数资料
型号: S1C17651B00E100
元件分类: 微控制器/微处理器
英文描述: 16-BIT, FLASH, 2 MHz, RISC MICROCONTROLLER, PBGA
文件页数: 6/216页
文件大小: 1784K
代理商: S1C17651B00E100
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12 16-BIT PWM TIMER (T16A2)
12-14
Seiko Epson Corporation
S1C17651 TECHNICAL MANUAL
T16A Counter Ch.x Data Register (T16A_TCx)
Register name Address
Bit
Name
Function
Setting
Init. R/W
Remarks
T16A Counter
Ch.x Data
Register
(T16A_TCx)
0x5402
(16 bits)
D15–0 T16A2TC
[15:0]
Counter data
T16A2TC15 = MSB
T16A2TC0 = LSB
0x0 to 0xffff
0x0
R
D[15:0]
T16A2TC[15:0]: Counter Data Bits
Counter data can be read out. (Default: 0x0)
The counter value can be read out even if the counter is running. However, the counter value should be
read at once using a 16-bit transfer instruction. If data is read twice using an 8-bit transfer instruction,
the correct value may not be obtained due to occurrence of count up between readings.
T16A Comparator/Capture Ch.x Control Register (T16A_CCCTLx)
Register name Address
Bit
Name
Function
Setting
Init. R/W
Remarks
T16A
Comparator/
Capture Ch.x
Control Register
(T16A_CCCTLx)
0x5404
(16 bits)
D15–14 CAPBTRG
[1:0]
Capture B trigger select
CAPBTRG[1:0] Trigger edge
0x0 R/W
0x3
0x2
0x1
0x0
↑ and ↓
None
D13–12 TOUTBMD
[1:0]
TOUT B mode select
TOUTBMD[1:0]
Mode
0x0 R/W
0x3
0x2
0x1
0x0
cmp B:
↑ or ↓
cmp A:
↑ or ↓
cmp A:
↑, B: ↓
Off
D11–10 –
reserved
0 when being read.
D9
TOUTBINV TOUT B invert
1 Invert
0 Normal
0
R/W
D8
CCBMD
T16A_CCB register mode select
1 Capture
0 Comparator
0
R/W
D7–6 CAPATRG
[1:0]
Capture A trigger select
CAPATRG[1:0] Trigger edge
0x0 R/W
0x3
0x2
0x1
0x0
↑ and ↓
None
D5–4 TOUTAMD
[1:0]
TOUT A mode select
TOUTAMD[1:0]
Mode
0x0 R/W
0x3
0x2
0x1
0x0
cmp B:
↑ or ↓
cmp A:
↑ or ↓
cmp A:
↑, B: ↓
Off
D3–2 –
reserved
0 when being read.
D1
TOUTAINV TOUT A invert
1 Invert
0 Normal
0
R/W
D0
CCAMD
T16A_CCA register mode select
1 Capture
0 Comparator
0
R/W
D[15:14] CAPBTRG[1:0]: Capture B Trigger Select Bits
Selects the trigger edge(s) of the external signal (CAPBx) at which the counter value is captured in the
capture B register.
8.4 Capture B Trigger Edge Selection
Table 12.
CAPBTRG[1:0]
Trigger edge
0x3
Falling edge and rising edge
0x2
Falling edge
0x1
Rising edge
0x0
Not triggered
(Default: 0x0)
CAPBTRG[1:0] are control bits for capture mode and are ineffective in comparator mode.
D[13:12] TOUTBMD[1:0]: TOUT B Mode Select Bits
Configures how the TOUT B signal waveform (TOUTBx output) is changed by the compare A and
compare B signals. These bits are also used to turn the TOUT B output On and Off.
8.5 TOUT B Generation Mode
Table 12.
TOUTBMD[1:0]
When compare A occurs When compare B occurs
0x3
No change
Toggle
0x2
Toggle
No change
0x1
Rise
Fall
0x0
Disable output
(Default: 0x0)
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