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参数资料
| 型号： | S1C17651B00E100 |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, FLASH, 2 MHz, RISC MICROCONTROLLER, PBGA |
| 文件页数： | 7/216页 |
| 文件大小： | 1784K |
| 代理商： | S1C17651B00E100 |
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12 16-BIT PWM TIMER (T16A2)
S1C17651 TECHNICAL MANUAL
Seiko Epson Corporation
12-15
TOUTBMD[1:0] are control bits for comparator mode and are ineffective in capture mode.
D[11:10] Reserved
D9
TOUTBINV: TOUT B Invert Bit
Selects the TOUT B signal (TOUTBx output) polarity.
1 (R/W): Inverted (active Low)
0 (R/W): Normal (active High) (default)
Writing 1 to TOUTBINV generates an active Low signal (Off level = High) for the TOUT B output.
When TOUTBINV is 0, an active High signal (Off level = Low) is generated.
TOUTBINV is a control bit for comparator mode and is ineffective in capture mode.
D8
CCBMD: T16A_CCB Register Mode Select Bit
Selects the T16A_CCBx register function (comparator mode or capture mode).
1 (R/W): Capture mode
0 (R/W): Comparator mode (default)
Writing 1 to CCBMD configures the T16A_CCBx register as the capture B register (capture mode) to
which the counter data will be loaded by the external trigger signal. When CCBMD is 0, the T16A_
CCBx register functions as the compare B register (comparator mode) for writing a comparison value to
generate the compare B signal.
D[7:6]
CAPATRG[1:0]: Capture A Trigger Select Bits
Selects the trigger edge(s) of the external signal (CAPAx) at which the counter value is captured in the
capture A register.
8.6 Capture A Trigger Edge Selection
Table 12.
CAPATRG[1:0]
Trigger edge
0x3
Falling edge and rising edge
0x2
Falling edge
0x1
Rising edge
0x0
Not triggered
(Default: 0x0)
CAPATRG[1:0] are control bits for capture mode and are ineffective in comparator mode.
D[5:4]
TOUTAMD[1:0]: TOUT A Mode Select Bits
Configures how the TOUT A signal waveform (TOUTAx output) is changed by the compare A and
compare B signals. These bits are also used to turn the TOUT A output On and Off.
8.7 TOUT A Generation Mode
Table 12.
TOUTAMD[1:0]
When compare A occurs When compare B occurs
0x3
No change
Toggle
0x2
Toggle
No change
0x1
Rise
Fall
0x0
Disable output
(Default: 0x0)
TOUTAMD[1:0] are control bits for comparator mode and are ineffective in capture mode.
D[3:2]
Reserved
D1
TOUTAINV: TOUT A Invert Bit
Selects the TOUT A signal (TOUTAx output) polarity.
1 (R/W): Inverted (active Low)
0 (R/W): Normal (active High) (default)
Writing 1 to TOUTAINV generates an active Low signal (Off level = High) for the TOUT A output.
When TOUTAINV is 0, an active High signal (Off level = Low) is generated.
TOUTAINV is a control bit for comparator mode and is ineffective in capture mode.
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PDF描述 |
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