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参数资料
型号： S1C17651B00E10C
元件分类： 微控制器/微处理器
英文描述： 16-BIT, FLASH, 2 MHz, RISC MICROCONTROLLER, PBGA
文件页数： 139/216页
文件大小： 1784K
代理商： S1C17651B00E10C
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4 POWER SUPPLY
S1C17651 TECHNICAL MANUAL
Seiko Epson Corporation
4-3
Booster clock enable
The booster clock supply is enabled with LCDBCLKE/LCD_BCLK register. The LCDBCLKE default
setting is 0, which stops the clock. Setting LCDBCLKE to 1 feeds the clock generated as above to the LCD
power supply circuit. If no LCD display is required, stop the clock to reduce current consumption.
Heavy Load Protection Mode
4.3.3
In order to ensure a stable circuit behavior and LCD display quality even if the power supply voltage fluctuates due
to driving an external load, the regulators have a heavy load protection function.
The table below lists the control bits used for setting heavy load protection mode.
3.3.1 Heavy Load Protection Mode Control Bits
Table 4.
Regulator
Control bit
VD1 regulator
HVLD/VD1_CTL register
VOSC regulator
VC regulator
LHVLD/LCD _VREG register
When the control bit is set to 1, the regulator ensures stable output.
The VD1 and VOSC regulators should be placed into heavy load protection mode before driving a heavy load such as
a lamp or buzzer with a port output. The VC regulator should be placed into heavy load protection mode when the
display has inconsistencies in density.
Note: Current consumption increases in heavy load protection mode, therefore do not set heavy load
protection mode with software if unnecessary.
Control Register Details
4.4
4.1 List of Power Control Registers
Table 4.
Address
Register name
Function
0x5071
LCD_BCLK
LCD Booster Clock Control Register
Controls the LCD booster clock.
0x50a3
LCD_VREG LCD Voltage Regulator Control Register
Controls the VC regulator.
0x5120
VD1_CTL
VD1 Control Register
Controls the VD1 regulator.
The power control registers are described in detail below.
Note: When data is written to the registers, the “Reserved” bits must always be written as 0 and not 1.
LCD Booster Clock Control Register (LCD_BCLK)
Register name Address
Bit
Name
Function
Setting
Init. R/W
Remarks
LCD Booster
Clock Control
Register
(LCD_BCLK)
0x5071
(8 bits)
D7
–
reserved
–
0 when being read.
D6–4 LCDBCLKD
[2:0]
LCD booster clock division ratio
select
LCDB
CLKD
[2:0]
Division ratio
0x0 R/W
OSC3B OSC3A OSC1
0x7
0x6
0x5
0x4
0x3
0x2
0x1
0x0
–
1/4096
1/2048
1/1024
1/512
1/256
1/128
1/64
–
1/8192
1/4096
1/2048
1/1024
1/512
1/256
1/128
–
1/64
1/32
1/16
1/8
D3–2 LCDBCLK
SRC[1:0]
LCD Booster clock source select
LCDBCLK
SRC[1:0]
Clock source
0x0 R/W
0x3
0x2
0x1
0x0
reserved
OSC3A
OSC1
OSC3B
D1
–
reserved
–
0 when being read.
D0
LCDBCLKE LCD Booster clock enable
1 Enable
0 Disable
0
R/W
D7
Reserved
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