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参数资料
型号： S1C17651B00E10C
元件分类： 微控制器/微处理器
英文描述： 16-BIT, FLASH, 2 MHz, RISC MICROCONTROLLER, PBGA
文件页数： 174/216页
文件大小： 1784K
代理商： S1C17651B00E10C
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8 THEORETICAL REGULATION (TR)
S1C17651 TECHNICAL MANUAL
Seiko Epson Corporation
8-3
Control Register Details
8.4
4.1 List of TR Registers
Table 8.
Address
Register name
Function
0x5078
TR_CTL
TR Control Register
Controls theoretical regulation.
0x5079
TR_VAL
TR Value Register
Sets a regulation value.
The TR module registers are described in detail below.
Note: When data is written to the registers, the “Reserved” bits must always be written as 0 and not 1.
TR Control Register (TR_CTL)
Register name Address
Bit
Name
Function
Setting
Init. R/W
Remarks
TR Control
Register
(TR_CTL)
0x5078
(8 bits)
D7–4 –
reserved
–
0 when being read.
D3
RCLKFSEL Monitor clock frequency select
1 1 Hz
0 256 Hz
0
R/W
D2
RCLKMON Regulated clock monitor enable
1 Enable
0 Disable
0
R/W
D1
–
reserved
–
0 when being read.
D0
REGTRIG
Regulation trigger
1 Trigger
0 Ignored
0
W
D[7:4]
Reserved
D3
RCLKFSEL: Monitor Clock Frequency Select Bit
Selects the regulated clock to be output from the REGMON pin for monitoring.
1 (R/W): F1 (1 Hz)
0 (R/W): F256 (256 Hz) (default)
D2
RCLKMON: Regulated Clock Monitor Enable Bit
Controls the clock monitor output from the REGMON pin.
1 (R/W): Enabled (On)
0 (R/W): Disabled (Off) (default)
Setting RCLKMON to 1 outputs the clock selected by RCLKFSEL from the REGMON pin.
D1
Reserved
D0
REGTRIG: Regulation Trigger Bit
Executes theoretical regulation.
1 (W):
Trigger
0 (W):
Ignored (default)
Theoretical regulation is performed only once by writing 1 to REGTRIG.
Note that a maximum 16.6 ms of delay occurs before theoretical regulation actually starts after writing
to REGTRIG. Writing 1 to REGTRIG in this period is ineffective, so to write 1 to REGTRIG succes-
sively, an interval at least 16.6 ms is necessary between writings.
TR Value Register (TR_VAL)
Register name Address
Bit
Name
Function
Setting
Init. R/W
Remarks
TR Value
Register
(TR_VAL)
0x5079
(8 bits)
D7–5 –
reserved
–
0 when being read.
D4–0 TRIM[4:0]
Regulation value
TRIM[4:0]
Regulation
value
0x0 R/W
0xf
0xe
:
0x1
0x0
+16
+15
:
+2
+1
0x1f
0x1e
:
0x11
0x10
0
-1
:
-14
-15
D[7:5]
Reserved
D[4:0]
TRIM[4:0]: Regulation Value Bits
Specifies the correction value (-15/32768 to +16/32768) for theoretical regulation.
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PDF描述
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