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参数资料
| 型号： | ST40RA200XH6E |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 200 MHz, RISC PROCESSOR, PBGA372 |
| 封装： | 27 X 27 MM, 2.33 MM HEIGHT, PLASTIC, BGA-372 |
| 文件页数： | 31/94页 |
| 文件大小： | 2144K |
| 代理商： | ST40RA200XH6E |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页当前第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页
5 System configuration
ST40RA
37/92
5.9.1
EMI.GENCFG EMI general configuration
EMI.GENCFG
EMI general configuration
0x0028
The EMI provides a generic register to allow the configuration of the padlogic. ST40RA
uses the bits detailed.
0SOFE
Strobe positioning
Strobe on falling edge:
0: Disabled
1: Enabled
Reset: 0
RW
[5:1]
SDPOS
SDRAM bank location
00001: Bank 0
00010: Bank 1
00011: Bank 2
00100: Bank 3
00101: Bank 4
00110: Bank 5
10001: Bank 0 to 1
10010: Bank 0 to 2
10011: Bank 0 to 3
10100: Bank 0 to 4
10101: Bank 0 to 5
10110: Bank 1 to 2
10111: Bank 1 to 3
11000: Bank 1 to 4
11001: Bank 1 to 5
11010: Bank 2 to 3
11011: Bank 2 to 4
11100: Bank 2 to 5
11101: Bank 3 to 4
11110: Bank 3 to 5
11111: Bank 4 to 5
Reset: 0
RW
6EWPU
Pull-up on EWAIT pina
0: Disabled
1: Enabled
Reset: 0
a. If the EWAIT signal is set at the beginning of an access, and the data is to be set after the EWAIT
is cleared, the parameters ACCESSTIMEREAD and LATCHPOINT in the EMI configuration
registers must be set as follows:
ACCESSTIME > LATCHPOINT + 3.
See the ST40 System Architecture Manual, Volume 2: Bus Interfaces for details of setting the EMI
configuration registers.
RW
7
EAPU
Pull-up enable on EADDR pins
0: Disabled
1: Enabled
Reset: 0
RW
[31:8]
Reserved
0: Ignored
1: Reserved
Reset: Undefined
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PDF描述 |
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