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参数资料
| 型号： | ST40RA200XH6E |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 200 MHz, RISC PROCESSOR, PBGA372 |
| 封装： | 27 X 27 MM, 2.33 MM HEIGHT, PLASTIC, BGA-372 |
| 文件页数： | 69/94页 |
| 文件大小： | 2144K |
| 代理商： | ST40RA200XH6E |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页当前第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页
7 Electrical specifications
ST40RA
71/92
7.11
UDI and IEEE 1149.1 TAP AC specifications
Table 35: TAP timings
Symbol
Parameter
Min
Nom
Max
Units
Notes
tTCHTCH
TCK period
50
ns
a
a. During IEEE1149.1 drive board level manufacturing tests only TCK is active.
tDCHDCH
DCK period
50
ns
b
b. During application level diagnostics only DCLK is active.
tTIVTCH
TAP inputs setup to TCK/DCK high
5
ns
tTCHTIX
TAP input hold after TCK/DCK high
5
ns
tTCHTOV
TCK/DCK low to TAP output valid
10
ns
Figure 19: UDI and IEEE TAP timings
TCK
TDI
TDO
tTIVTCH
tTCHTIX
tTCHTOV
TMS
tTCHTCH
DCK
tDCHTIX
tDCHDCH
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