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参数资料
| 型号： | ST40RA200XH6E |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 200 MHz, RISC PROCESSOR, PBGA372 |
| 封装： | 27 X 27 MM, 2.33 MM HEIGHT, PLASTIC, BGA-372 |
| 文件页数： | 84/94页 |
| 文件大小： | 2144K |
| 代理商： | ST40RA200XH6E |
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8 Pin description
ST40RA
85/92
8.4
Pin states
The following table shows the direction and state of the pins during and immediately after reset.
● Z indicates an output or I/O pin that has been tri-stated.
● I indicates an input or I/O pin in input modes (I/O buffer tri-stated).
● 1 indicates an output or I/O pin driving logical high.
● 0 indicates an output or I/O pin driving logical low.
● X indicates an output or I/O pin driving undefined data.
● H indicates a pin with weak internal pull-up enabled.
● L indicates a pin with weak internal pull-down enabled.
Table 39: Pin reset states for ST40RA
Pin names
Architecturally defined
reset state
Implementation reset state during and after
reset
Dir
During reset
Dir
During reset
Following reset
LMI system pins
LDATA0:63
I/O
Z
I/O
Z
LBANK0:1
O
X
I/O
11
LADDR0:14
O
X
I/O
1...1
LDQS0:7
I/O
Z
I/O
Z
LCLKOUTA:B
O
1
I/O
X
NOTLCLKOUTA:B
O
0
I/O
X
LDQM0:7
O
X
I/O
X
NOTLCSA/B0:1,
O
1
I/O
11
NOTLRASA:B,
NOTLCASA:B, NOTLWEA:B
O
1
I/O
1
LCLKEN0:1
O
0
I/O
0
PCI system pins
PAD0:31
I/O
0
I/O
0
NOTPCBE0:3
I/O
0
I/O
0
PPAR
I/O
0
I/O
0
NOTPFRAME
I/O
1
I/O
H
NOT PIRDY
I/O
1
I/O
H
NOTPTRDY
I/O
1
I/O
H
NOTPSTOP
I/O
1
I/O
H
NOTPERR
I/O
1
I/O
H
NOTPSERR
I/O
1
I/O
H
NOTPDEVSEL
I/O
1
I/O
H
PIDSEL
I/O
0
I
0
NOTPRST
I/O
0
I/O
0
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