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参数资料
| 型号： | ST40RA200XH6E |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 200 MHz, RISC PROCESSOR, PBGA372 |
| 封装： | 27 X 27 MM, 2.33 MM HEIGHT, PLASTIC, BGA-372 |
| 文件页数： | 56/94页 |
| 文件大小： | 2144K |
| 代理商： | ST40RA200XH6E |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页当前第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页
ST40RA
A Interconnect architecture
A
Interconnect architecture
This detail is included for information only. It is not recommended to write to any of these registers,
without prior consultation from ST, as it could cause the device to malfunction.
ST only guarantees correct operation of the device with the default register values. The register
reset default values have been programmed to balance the system and give optimum system
performance, so there is no need to modify them.
For details of other registers see the ST40 System Architecture Manual.
The internal architecture of the block is shown in Figure 1.
Figure 1: ST40RA interconnect architecture
LMI
T3
64
64-bit
full
cross bar
T3/
T
3
32
/6
4
T3/
T
3
64/32
conn_2 x 2
EMI
T3
32
EMPI
T3
32
SH4 subsystem
subsystem
T3
32
ST40 core
CPU
P
LP
UG
Cpu
_pl
ug
f_
con
v
PER
SH_PE
R
T1
32
T3
32
PER
sub
PI
Node 2
CPU subsystem
Node 1
T1
32
T3
32
T3
32
PCI
1
00
MHz
GPDMA
T3
32
PCI
(t)
100 MHz
1
T3
64
T3/T
1
32/32
32-bit
conn_4 x 4
Full cross bar
Programming
port
Programming
port
T3
32
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