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参数资料
| 型号： | ST40RA200XH6E |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 200 MHz, RISC PROCESSOR, PBGA372 |
| 封装： | 27 X 27 MM, 2.33 MM HEIGHT, PLASTIC, BGA-372 |
| 文件页数： | 35/94页 |
| 文件大小： | 2144K |
| 代理商： | ST40RA200XH6E |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页当前第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页
40/92
ST40RA
5 System configuration
5.9.4.2 SYSCONF.SYS_CON1
.
Where the two clocks are sourced from independent PLLs the bridge must be put in asynchronous
mode.
5.9.5
SYSCONF.SYS_CON2.
SYSCONF.SYS_CON1
Memory bridge control
0x010
[3:0]
Reserved
RW
[10:4]
MB1
Memory bridge 1 control: EMI target
RW
[17:11]
MB2
Memory bridge 2 control: EMPI initiator
RW
[24:18]
MB3
Memory bridge 3 control: EMI_SS target
RW
[38:25]
Reserved
[45:39]
MB6
Memory bridge 6 control: PCI initiator
RW
[52:46]
MB7
Memory bridge 7 control: PCI target
RW
[63:53]
Reserved
SYSCONF.SYS_CON2
Functional pin use and behavior
0x0018
The SYSCONF.SYS_CON2 register controls functional pin use and behavior
8LMI_MODE
LMI pad type
0: SSTL
1: LVTTL
Reset: 0
RW
9LMI_ENVREF
Reference voltage source
0: internally generated reference voltage
1: external reference voltage from VREF pins
Reset: 0
RW
10
LMI_ECLK_BYPASS
LMI control signal ECLK180 retime bypass
0: ECLK180 flip flop not bypassed
1: ECLK180 flip flop is bypassed
Reset: 0
RW
11
LMI_NOTCOMP25_EN
Enable LMI 2.5 V compensation cell
0: LMI 2.5 V compensation cell enabled
1: LMI 2.5 V compensation cell disabled
Reset: 0
RW
12
LMI_COMP33_EN
Enable LMI 3.3 V compensation cell
0: LMI 2.5 V compensation cell enabled
1: LMI 2.5 V compensation cell disabled
Reset: 0
RW
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