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参数资料
| 型号： | ST40RA200XH6E |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 200 MHz, RISC PROCESSOR, PBGA372 |
| 封装： | 27 X 27 MM, 2.33 MM HEIGHT, PLASTIC, BGA-372 |
| 文件页数： | 50/94页 |
| 文件大小： | 2144K |
| 代理商： | ST40RA200XH6E |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页当前第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页
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ST40RA
6 Clock generation
6.6.3
CLOCKGENA.STBREQCR and CLOCKGENB.STBREQCR registers
6.6.4
CLOCKGENA.STBREQCR_SET and CLOCKGENB.STBREQCR_SET registers
6.6.5
CLOCKGENA.STBREQCR_CLR and CLOCKGENB.STBREQCR_CLR register
CLOCKGENA.STBREQCR
CLOCKGENB.STBREQCR
Control power down requests
0x0018
This register gives direct access to the power down request register. Low power requests are made in
the STBREQCR_SET register and cleared in the STBREQCR_CLR register.
[0:7]
REQ[0:7]
Power down requests for module [n]
Controls the power down state for module [n]
Bit [n]: 0 Request module [n] to operate normally
Bit [n]: 1 Request module [n] to power down
Reset state: 0
RW
[8:31]
Reserved
0: No action
1: Undefined
Reset state: Undefined
CLOCKGENA.STBREQCR_SET
CLOCKGENB.STBREQCR_SET
Set power down requests
0x0020
This register sets a low power request.
[0:7]
SET[0:7]
Set power down request for module [n]
Sets the power down request state for module [n]
Bit [n]: 0 No action
Bit [n]: 1 Set power down request
Reset state: 0
WO
[8:31]
Reserved
0: No action
1: Undefined
Reset state: Undefined
CLOCKGENA.STBREQCR_CLR
CLOCKGENB.STBREQCR_CLR
Clear power down requests
0x0028
This register clears a low power request and recommences the clock supply to a module.
[0:7]
CLR[0:7]
Clear power down request for module [n]
Clears the power down request state for module [n]
Bit [n]: 0 No action
Bit [n]: 1 Clear power down request
Reset state: 0
WO
[8:31]
Reserved
0: No action
1: Undefined
Reset state: Undefined
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