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参数资料
| 型号： | ST40RA200XH6E |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 200 MHz, RISC PROCESSOR, PBGA372 |
| 封装： | 27 X 27 MM, 2.33 MM HEIGHT, PLASTIC, BGA-372 |
| 文件页数： | 67/94页 |
| 文件大小： | 2144K |
| 代理商： | ST40RA200XH6E |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页当前第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页
A Interconnect architecture
ST40RA
A.1
Arbitration schemes
A.1.1
PCI arbiter: (CPU, GPDMA, PCI, EMPI)
The default configuration (after reset) for fixed priority mode has to be in the following priority order:
● CPU buffer,
● EMPI,
● GPDMA,
● PCI (PCI master request, although not expected, get served to avoid deadlock).
The priority orders have to be programmable and the latency checking algorithm can be enabled for
GPDMA, PCI, EMPI.
A.1.2
EMI arbiter: (CPU buffer, GPDMA, PCI, EMPI)
The default configuration (after reset) for fixed priority mode has to be in the following priority order:
● CPU buffer,
● PCI,
● EMPI,
● GPDMA.
The priority order have to be programmable and the latency checking algorithm can be enabled for
GPDMA, PCI, EMPI.
A.1.3
LMI 1 arbiter: (CPU, GPDMA, PCI, EMPI)
The default configuration (after reset) as to be to work fixed priority mode in the following priority
order:
● CPU,
● GPDMA and PCI buffer.
The priority orders have to be programmable and the latency checking algorithm can be enabled for
GPDMA, PCI, EMPI.
A.1.4
PER arbiter: (CPU, GPDMA, PCI, EMPI)
The default configuration (after reset) as to be to work fixed priority mode in the following priority
order:
● CPU buffer,
● PCI,
● EMPI,
● GPDMA.
The priority order have to be programmable and the latency checking algorithm can be enabled for
GPDMA, PCI, EMPI.
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