参数资料
| 型号： | TDGL007 |
| 厂商： | Microchip Technology |
| 文件页数： | 144/374页 |
| 文件大小： | 0K |
| 描述： | BOARD MOTOR CTRL DSPIC337128MC |
| 设计资源： | Cerebot MC7 Schematics |
| 标准包装： | 1 |
| 主要目的： | 电源管理，电机控制 |
| 嵌入式： | 是，MCU，16 位 |
| 已用 IC / 零件： | dsPIC33FJ128MC706A |
| 主要属性： | 四个24V/5A半桥电路 |
| 次要属性： | 8RC伺服连接器 |
| 已供物品： | 板 |
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dsPIC33FJXXXMCX06A/X08A/X10A
9.1 CPU Clocking System
There are seven system clock options provided by the
dsPIC33FJXXXMCX06A/X08A/X10A:
POSCMD<1:0> (FOSC<1:0>), select the oscillator
source that is used at a Power-on Reset. The FRC
primary oscillator is the default (unprogrammed)
selection.
?
?
?
?
?
?
?
FRC Oscillator
FRC Oscillator with PLL
Primary (XT, HS or EC) Oscillator
Primary Oscillator with PLL
Secondary (LP) Oscillator
LPRC Oscillator
FRC Oscillator with Postscaler
The Configuration bits allow users to choose between
The output of the oscillator (or the output of the PLL if a
PLL mode has been selected), F OSC , is divided by 2 to
generate the device instruction clock (F CY ) and the
peripheral clock time base (F P ). F CY defines the
operating speed of the device and speeds up to 40 MHz
are supported by the dsPIC33FJXXXMCX06A/X08A/
9.1.1
SYSTEM CLOCK SOURCES
X10A architecture.
The FRC (Fast RC) internal oscillator runs at a nominal
frequency of 7.37 MHz. The user software can tune the
FRC frequency. User software can optionally specify a
Instruction execution speed or device operating
frequency, F CY , is given by the following equation:
factor (ranging from 1:2 to 1:256) by which the FRC
EQUATION 9-1:
DEVICE OPERATING
F CY = -------------
clock frequency is divided. This factor is selected using
the FRCDIV<2:0> bits (CLKDIV<10:8>).
The primary oscillator can use one of the following as
its clock source:
1. XT (Crystal): Crystals and ceramic resonators in
the range of 3 MHz to 10 MHz. The crystal is
connected to the OSC1 and OSC2 pins.
2. HS (High-Speed Crystal): Crystals in the range
of 10 MHz to 40 MHz. The crystal is connected
to the OSC1 and OSC2 pins.
3. EC (External Clock): External clock signal is
directly applied to the OSC1 pin.
The secondary (LP) oscillator is designed for low power
and uses a 32.768 kHz crystal or ceramic resonator.
The LP oscillator uses the SOSCI and SOSCO pins.
The LPRC (Low-Power RC) internal oscIllator runs at a
nominal frequency of 32.768 kHz. It is also used as a
reference clock by the Watchdog Timer (WDT) and
Fail-Safe Clock Monitor (FSCM).
The clock signals generated by the FRC and primary
oscillators can be optionally applied to an on-chip
Phase-Locked Loop (PLL) to provide a wide range of
output frequencies for device operation. PLL
The FRC frequency depends on the FRC accuracy
(see Table 26-19 ) and the value of the FRC Oscillator
Tuning register (see Register 9-4 ).
FREQUENCY
F OSC
2
9.1.3 PLL CONFIGURATION
The primary oscillator and internal FRC oscillator can
optionally use an on-chip PLL to obtain higher speeds
of operation. The PLL provides a significant amount of
flexibility in selecting the device operating speed. A
The output of the primary oscillator or FRC, denoted as
‘F IN ’, is divided down by a prescale factor (N1) of 2,
3, ... or 33 before being provided to the PLL’s Voltage
Controlled Oscillator (VCO). The input to the VCO must
be selected to be in the range of 0.8 MHz to 8 MHz.
Since the minimum prescale factor is 2, this implies that
F IN must be chosen to be in the range of 1.6 MHz to
16 MHz. The prescale factor, ‘N1’, is selected using the
PLLPRE<4:0> bits (CLKDIV<4:0>).
The PLL feedback divisor, selected using the
PLLDIV<8:0> bits (PLLFBD<8:0>), provides a factor, ‘M’,
by which the input to the VCO is multiplied. This factor
must be selected such that the resulting VCO output
frequency is in the range of 100 MHz to 200 MHz.
The VCO output is further divided by a postscale factor,
‘N2’. This factor is selected using the PLLPOST<1:0>
bits (CLKDIV<7:6>). ‘N2’ can be either 2, 4 or 8, and
must be selected such that the PLL output frequency
9.1.2
SYSTEM CLOCK SELECTION
(F OSC ) is in the range of 12.5 MHz to 80 MHz, which
generates device operating speeds of 6.25-40 MIPS.
The oscillator source that is used at a device Power-on
Reset event is selected using Configuration bit settings.
The oscillator Configuration bit settings are located in
the Configuration registers in the program memory.
For a primary oscillator or FRC oscillator output, ‘F IN ’,
the PLL output, ‘F OSC ’, is given by the following
equation:
(Refer to Section 23.1 “Configuration Bits” for further
EQUATION 9-2:
F OSC CALCULATION
F OSC = F IN ? ? ------------------- ?
details.) The Initial Oscillator Selection Configuration
bits, FNOSC<2:0> (FOSCSEL<2:0>), and the Primary
Oscillator Mode Select Configuration bits,
DS70594D-page 144
M
? N 1 ? N 2 ?
? 2009-2012 Microchip Technology Inc.
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