参数资料
| 型号： | TDGL007 |
| 厂商： | Microchip Technology |
| 文件页数： | 79/374页 |
| 文件大小： | 0K |
| 描述： | BOARD MOTOR CTRL DSPIC337128MC |
| 设计资源： | Cerebot MC7 Schematics |
| 标准包装： | 1 |
| 主要目的： | 电源管理，电机控制 |
| 嵌入式： | 是，MCU，16 位 |
| 已用 IC / 零件： | dsPIC33FJ128MC706A |
| 主要属性： | 四个24V/5A半桥电路 |
| 次要属性： | 8RC伺服连接器 |
| 已供物品： | 板 |
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dsPIC33FJXXXMCX06A/X08A/X10A
6.0
RESET
A simplified block diagram of the Reset module is
Note 1: This data sheet summarizes the fea-
tures of the dsPIC33FJXXXMCX06A/
X08A/X10A family of devices. How-
ever, it is not intended to be a compre-
hensive reference source. To
complement the information in this
data sheet, refer to Section 8.
“Reset” (DS70192) in the “dsPIC33F/
PIC24H Family Reference Manual” ,
which is available from the Microchip
web site ( www.microchip.com ).
2: Some registers and associated bits
described in this section may not be
available on all devices. Refer to
this data sheet for device-specific register
and bit information.
The Reset module combines all Reset sources and
controls the device Master Reset Signal, SYSRST. The
following is a list of device Reset sources:
? POR: Power-on Reset
? BOR: Brown-out Reset
? MCLR: Master Clear Pin Reset
? SWR: RESET Instruction
? WDT: Watchdog Timer Reset
Any active source of Reset will make the SYSRST
signal active. Many registers associated with the CPU
and peripherals are forced to a known Reset state.
Most registers are unaffected by a Reset; their status is
unknown on POR and unchanged by all other Resets.
Note: Refer to the specific peripheral or CPU
section of this data sheet for register
Reset states.
All types of device Reset will set a corresponding status
bit in the RCON register to indicate the type of Reset
(see Register 6-1 ). A POR will clear all bits except for
the POR bit (RCON<0>), which is set. The user can set
or clear any bit at any time during code execution. The
RCON bits only serve as status bits. Setting a particular
Reset status bit in software does not cause a device
Reset to occur.
The RCON register also has other bits associated with
the Watchdog Timer and device power-saving states.
The function of these bits is discussed in other sections
of this manual.
Note: The status bits in the RCON register
should be cleared after they are read so
that the next RCON register value after a
device Reset will be meaningful.
?
?
TRAPR: Trap Conflict Reset
IOPUWR: Illegal Opcode and Uninitialized W
Register Reset
FIGURE 6-1:
MCLR
RESET SYSTEM BLOCK DIAGRAM
RESET Instruction
Glitch Filter
WDT
Module
Sleep or Idle
V DD
Internal
Regulator
V DD Rise
Detect
BOR
POR
SYSRST
Trap Conflict
Illegal Opcode
Uninitialized W Register
? 2009-2012 Microchip Technology Inc.
DS70594D-page 79
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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