参数资料
| 型号： | TDGL007 |
| 厂商： | Microchip Technology |
| 文件页数： | 85/374页 |
| 文件大小： | 0K |
| 描述： | BOARD MOTOR CTRL DSPIC337128MC |
| 设计资源： | Cerebot MC7 Schematics |
| 标准包装： | 1 |
| 主要目的： | 电源管理，电机控制 |
| 嵌入式： | 是，MCU，16 位 |
| 已用 IC / 零件： | dsPIC33FJ128MC706A |
| 主要属性： | 四个24V/5A半桥电路 |
| 次要属性： | 8RC伺服连接器 |
| 已供物品： | 板 |
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dsPIC33FJXXXMCX06A/X08A/X10A
7.0
INTERRUPT CONTROLLER
The dsPIC33FJXXXMCX06A/X08A/X10A family of
devices implement up to 67 unique interrupts and five
Note 1: This data sheet summarizes the fea-
tures of the dsPIC33FJXXXMCX06A/
nonmaskable traps. These are summarized in
X08A/X10A family of devices. How-
ever, it is not intended to be a compre-
hensive reference source. To
7.1.1
ALTERNATE INTERRUPT VECTOR
TABLE
complement the information in this data
sheet, refer to Section 6. “Interrupts”
(DS70184) in the “dsPIC33F/PIC24H
Family Reference Manual” , which is
available from the Microchip web site
( www.microchip.com ).
2: Some registers and associated bits
described in this section may not be
available on all devices. Refer to
this data sheet for device-specific register
and bit information.
The interrupt controller for the
dsPIC33FJXXXMCX06A/X08A/X10A family of devices
reduces the numerous peripheral interrupt request
The Alternate Interrupt Vector Table (AIVT) is located
after the IVT, as shown in Figure 7-1 . Access to the
AIVT is provided by the ALTIVT control bit
(INTCON2<15>). If the ALTIVT bit is set, all interrupt
and exception processes use the alternate vectors
instead of the default vectors. The alternate vectors are
organized in the same manner as the default vectors.
The AIVT supports debugging by providing a means to
switch between an application and a support
environment without requiring the interrupt vectors to
be reprogrammed. This feature also enables switching
between applications for evaluation of different
software algorithms at run time. If the AIVT is not
needed, the AIVT should be programmed with the
same addresses used in the IVT.
signals to a single interrupt request signal to the
dsPIC33FJXXXMCX06A/X08A/X10A CPU. It has the
7.2
Reset Sequence
following features:
? Up to eight processor exceptions and software
traps
? Seven user-selectable priority levels
? Interrupt Vector Table (IVT) with up to 118 vectors
? A unique vector for each interrupt or exception
source
? Fixed priority within a specified user priority level
? Alternate Interrupt Vector Table (AIVT) for debug
support
? Fixed interrupt entry and return latencies
A device Reset is not a true exception because the
interrupt controller is not involved in the Reset process.
The dsPIC33FJXXXMCX06A/X08A/X10A device
clears its registers in response to a Reset, which forces
the PC to zero. The digital signal controller then begins
program execution at location 0x000000. The user pro-
grams a GOTO instruction at the Reset address, which
redirects program execution to the appropriate start-up
routine.
Note: Any unimplemented or unused vector
locations in the IVT and AIVT should be
programmed with the address of a default
7.1
Interrupt Vector Table
interrupt handler routine that contains a
RESET instruction.
The IVT resides in program memory, starting at location
000004h. The IVT contains 126 vectors consisting of
eight nonmaskable trap vectors plus up to 118 sources
of interrupt. In general, each interrupt source has its
own vector. Each interrupt vector contains a 24-bit wide
address. The value programmed into each interrupt
vector location is the starting address of the associated
Interrupt Service Routine (ISR).
Interrupt vectors are prioritized in terms of their natural
priority; this priority is linked to their position in the
vector table. All other things being equal, lower
addresses have a higher natural priority. For example,
the interrupt associated with vector 0 will take priority
over interrupts at any other vector address.
? 2009-2012 Microchip Technology Inc.
DS70594D-page 85
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